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參數(shù)資料
| 型號(hào)： | CS4384-CQZR |
| 廠商： | Cirrus Logic Inc |
| 文件頁(yè)數(shù)： | 6/52頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC DAC 8CH 103DB 192KHZ 48-LQFP |
| 標(biāo)準(zhǔn)包裝： | 2,000 |
| 位數(shù)： | 24 |
| 數(shù)據(jù)接口： | 串行 |
| 轉(zhuǎn)換器數(shù)目： | 8 |
| 電壓電源： | 模擬和數(shù)字 |
| 功率耗散（最大）： | 520mW |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 48-LQFP |
| 供應(yīng)商設(shè)備封裝： | 48-LQFP |
| 包裝： | 帶卷 (TR) |
| 輸出數(shù)目和類型： | 8 電壓，單極 |
| 采樣率（每秒）： | 216k |
| 配用： | 598-1525-ND - BOARD EVAL FOR CS4384 DAC |
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14
DS620F1
CS4384
SWITCHING CHARACTERISTICS - PCM
(Inputs: Logic 0 = GND, Logic 1 = VLS, CL = 30 pF)
Notes:
14. After powering up, RST should be held low until after the power supplies and clocks are settled.
16. Not required for TDM Mode.
Parameters
Symbol
Min
Max
Units
RST pin Low Pulse Width
1-
ms
MCLK Frequency
1.024
55.2
MHz
MCLK Duty Cycle
45
55
%
Input Sample Rate - LRCK (Manual selection)
Single-Speed Mode
Double-Speed Mode
Quad-Speed Mode
Fs
4
50
100
54
108
216
kHz
Input Sample Rate - LRCK (Auto detect)
Single-Speed Mode
Double-Speed Mode
Quad-Speed Mode
Fs
4
84
170
54
108
216
kHz
LRCK Duty Cycle
45
55
%
SCLK Duty Cycle
45
55
%
SCLK High Time
tsckh
8-
ns
SCLK Low Time
tsckl
8-
ns
LRCK Edge to SCLK Rising Edge
tlcks
5-
ns
SCLK Rising Edge to LRCK Falling Edge
tlckd
5-
ns
SDIN Setup Time Before SCLK Rising Edge
tds
3-
ns
SDIN Hold Time After SCLK Rising Edge
tdh
5-
ns
SDINx
t
ds
SCLK
LRCK
MSB
t
dh
t
sckh
t
sckl
t
lcks
MSB-1
Figure 1. Serial Audio Interface Timing
Figure 2. TDM Serial Audio Interface Timing
sckh
sckl
t
SD IN 1
dh
t
ds
t
lcks
t
lckd
t
SCLK
LRCK
lcks
t
MS B
M SB-1
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PDF描述 |
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