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參數(shù)資料
| 型號： | BT2166AHF |
| 廠商： | BROOKTREE CORP |
| 元件分類： | 圖形處理器 |
| 英文描述： | GRAPHICS PROCESSOR, PQFP208 |
| 封裝： | MQFP-208 |
| 文件頁數(shù)： | 105/405頁 |
| 文件大?。?/td> | 2371K |
| 代理商： | BT2166AHF |
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Bt2166
Graphics/Video Controller
Brooktree
164
VIDEO INPUT SUBSYSTEM
Video Interface Port
L2166_A
Video Interface Port
The Video Interface Port (VIP) can be used to transfer compressed MPEG data
streams from system memory to an external slave device. The maximum number
of bytes transferred per FIFO-based command is 64k bytes. The maximum number
of bytes transferred per register-based command is 4 bytes.
For additional information on the VIP and a list of expected slave devices, refer
to the SGS-Thompson Microelectronic’s Video Interface Port (VIP) Specica-
tion 1.1.
The VIP interface consists of ve basic signals: two data, one control, a clock,
and an interrupt. The data and control signals are bidirectional. The clock is a mas-
ter-based output only signal, while the interrupt is a slave-based output signal.
These
signals
share
the
Video
Input
Subsytem’s
VHS_VIPHAD0,
VVS_VIPHAD1,
and
VACTIVE_VIPIRQ,
and
the
I2C
logic
pins
DDCSDA_VIPCLK and DDCSCL_VIPCTL. When VIP is enabled with
VIP_CNFG[1], the I2C function of DDCSDA_VIPCLK and DDCSCL_VIPCTL
must be disabled via GRP_I2C_CTRLW (see ‘‘I2C Control WRITE Register’’ on
page 83). Also, VID_VCR[3:2] (see Table 129 on page 170) must be set to 2’b10
to enable the ITU656 interface.
VIP is enabled with VIP_CNFG[1] and the external interrupt is set in
VIP_CNFG[6].
Typical FIFO and register transfer sequences are listed below.
FIFO Transfer Sequence:
1.
The DRAM address of the rst byte of compressed data is written into the
FIFO_ADDR register.
2.
The number of bytes to transfer minus one (N-1) is loaded into the
FIFO_COMMAND register along with the FIFO command (described in
the VIP Specication page 2.2.6). For FIFO writes, all transfer data must be
loaded into the DRAM before starting the transfer.
3.
VIP_CNFG[2] is written to ’b1 to start the transfer.
4.
VIP_CNFG[2] is cleared by the hardware to indicate the transfer is com-
plete. And, the device interrupt INT_SR[14] (see Table 108 on page 138) is
generated, thus signalling the end of a transfer.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| BT459KG80 | PALETTE-DAC DSPL CTLR, CPGA132 |
| BT459KPF135 | PALETTE-DAC DSPL CTLR, PQFP132 |
| BT459KPF80 | PALETTE-DAC DSPL CTLR, PQFP132 |
| BT459KPF110 | DISPLAY CONTROLLER, PALETTE-DAC DSPL CTLR, QFP132 |
| BT474KPJ85 | 256 X 24 PIXELS PALETTE-DAC DSPL CTLR, PQCC84 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| BT-21751-000 | 功能描述:麥克風(fēng) RoHS:否 制造商:Knowles Acoustics 方向性:Omnidirectional 阻抗:4.4 K Ohms 工作電壓:0.9 V to 10 V 靈敏度:- 53 dB 端接類型:Wire Leads 長度:5.56 mm 寬度:3.98 mm 深度:2.21 mm |
| BT-21751-005 | 功能描述:麥克風(fēng) RoHS:否 制造商:Knowles Acoustics 方向性:Omnidirectional 阻抗:4.4 K Ohms 工作電壓:0.9 V to 10 V 靈敏度:- 53 dB 端接類型:Wire Leads 長度:5.56 mm 寬度:3.98 mm 深度:2.21 mm |
| BT-21752-000 | 功能描述:麥克風(fēng) RoHS:否 制造商:Knowles Acoustics 方向性:Omnidirectional 阻抗:4.4 K Ohms 工作電壓:0.9 V to 10 V 靈敏度:- 53 dB 端接類型:Wire Leads 長度:5.56 mm 寬度:3.98 mm 深度:2.21 mm |
| BT-21754-000 | 功能描述:麥克風(fēng) RoHS:否 制造商:Knowles Acoustics 方向性:Omnidirectional 阻抗:4.4 K Ohms 工作電壓:0.9 V to 10 V 靈敏度:- 53 dB 端接類型:Wire Leads 長度:5.56 mm 寬度:3.98 mm 深度:2.21 mm |
| BT-21755-000 | 功能描述:麥克風(fēng) RoHS:否 制造商:Knowles Acoustics 方向性:Omnidirectional 阻抗:4.4 K Ohms 工作電壓:0.9 V to 10 V 靈敏度:- 53 dB 端接類型:Wire Leads 長度:5.56 mm 寬度:3.98 mm 深度:2.21 mm |
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