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參數(shù)資料
| 型號： | AX88796L |
| 廠商： | Electronic Theatre Controls, Inc. |
| 英文描述： | 3-in-1 Local Bus Fast Ethernet Controller |
| 中文描述： | 3合1本地總線快速以太網(wǎng)控制器 |
| 文件頁數(shù)： | 46/71頁 |
| 文件大?。?/td> | 931K |
| 代理商： | AX88796L |
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ASIX ELECTRONICS CORPORATION
46
AX88796 L 3-in-1 Local Bus Fast Ethernet Controller
5.2.10 MR17 –Autonegotiation Register A Bit Descriptions
FIELD
TYPE
17.15-13
R
Reserved. Always 0.
17.12
R
Next Page Wait.
17.11
R
Wait Link_Fail_Inhibit_Wait_Timer (Link Status Check).
17.10
R
Wait Autoneg_Wait_Timer (Link Status Check).
17.9
R
Wait Break_Link_Timer (Transmit Disable).
17.8
R
Parallel Detection Fault.
17.7
R
Autonegotiation Enable.
17.6
R
FLP Link Good Check.
17.5
R
Complete Acknowledge.
17.4
R
Acknowledge Detect.
17.3
R
FLP Link Good.
17.2
R
Link Status Check.
17.1
R
Ability Detect.
17.0
R
Transmit Disable.
DESCRIPTION
5.2.11 MR18 –Autonegotiation Register B Bit Descriptions
FIELD
TYPE
18.15
R
Receiving FLPs
. Any of FLP Capture, Clock, Data_0, or Data_1 (FLP
Rcv).
18.14
R
FLP Pass
(FLP Rcv).
18.13
R
Link Pulse Count
(FLP Rcv).
18.12
R
Link Pulse Detect
(FLP Rcv).
18.11
R
Test Pass
(NLP Rcv).
18.10
R
Test Fail Count
(NLP Rcv).
18.9
R
Test Fail Extend
(NLP Rcv).
18.8
R
Wait Max Timer Ack
(NLP Rcv).
18.7
R
Detect Freeze
(NLP Rcv).
18.6
R
Test Fail
(NLP Rcv).
18.5
R
Transmit Count Ack
(FLP Xmit).
18.4
R
Transmit Data Bit
(FLP Xmit).
18.3
R
Transmit Clock Bit
(FLP Xmit).
18.2
R
Transmit ability
(FLP Xmit).
18.1
R
Transmit Remaining Acknowledge
(FLP Xmit).
18.0
R
Idle
(FLP Xmit).
DESCRIPTION
5.2.12 MR20 –User Defined Register Bit Descriptions
FIELD
TYPE
20.[15:0]
R/W
The data written into this user-defined register appears on the
REG20_OUT[15:0] bus.
DESCRIPTION
相關PDF資料 |
PDF描述 |
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參數(shù)描述 |
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