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參數(shù)資料
| 型號(hào)： | AM79C971KCW |
| 廠商： | ADVANCED MICRO DEVICES INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | IC LOGIC 16211 24-BIT FET BUS SWITCH -40+85C TSSOP-56 35/TUBE |
| 中文描述： | 4 CHANNEL(S), 100M bps, LOCAL AREA NETWORK CONTROLLER, PQFP16 |
| 封裝： | PLASTIC, QFP-160 |
| 文件頁(yè)數(shù)： | 262/265頁(yè) |
| 文件大?。?/td> | 3190K |
| 代理商： | AM79C971KCW |
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I-4
External SRAM Configuration
90
F
FIFO DMA Transfers
Framing
Transmit and Receive Message Data
Encapsulation
Frequency Demands for Network Operation
Expansion Bus Interface
Full-Duplex
Link Status LED Support
Operation
Functions
Basic
Detailed
50
60
94
76
75
29
30
G
General Description
General Purpose Serial Interface
2
75
I
I/O Resources
IEEE 1149.1 (1990) Test Access Port
Interface
Boundary Scan Register
Instruction Register and Decoding Logic
Other Data Registers
Supported Instructions
TAP Finite State Machine
Initialization
Buffer Management Unit
Initialization Block
Description
DMA Transfers
LADRF
Mode
PADR
RDRA and TDRA
RLEN and TLEN
Input Signal Conditioning, MENDEC
Instruction Register and Decoding Logic
103
99
99
100
99
99
53
180
47
182
183
182
181
181
71
99
J
Jabber Function, Twisted Pair Transceiver
74
L
LADRF
LAPP Flow, Outline of
LAPP Setup
Late Collision
LED Support
Link Test Function, Twisted Pair Transceiver
Look-Ahead Packet Processing (LAPP) Concept D-1
Loopback Features
182
D-1
D-1
65
97
73
Media Independent Interface
Miscellaneous
Loss of Carrier
Low Latency Receive Configuration
69
69
65
92
M
MAC
Magic Packet Mode, Power Saving
Manchester Encoder/Decoder
Carrier Tracking and End of Message
Clock Acquisition
Data Decoding
External Clock Drive Characteristics
External Crystal Characteristics
Input Signal Conditioning
Jitter Tolerance Definition
MENDEC Transmit Path
PLL Tracking
Receiver Path
Transmitter Timing and Operation
Manufacturer Contact Information
Master Abort
Master Bus Interface Unit
Bus Acquisition
Bus Master DMA Transfers
Basic Burst Read Transfer
Basic Burst Write Transfer
Basic Non-Burst Write Transfer
Burst FIFO DMA Transfers
Descriptor DMA Transfers
Disconnect With Data Transfer
Disconnect Without Data Transfer
FIFO DMA Transfers
Initialization Block DMA Transfers
Master Abort
Master Initiated Termination
Non-Burst FIFO DMA Transfers
Parity Error Response
Preemption During Burst Transaction
Preemption During Non-Burst
Transaction
Master Initiated Termination
Media Access Control
Collision Handling
Destination Address Handling
Error Detection
Framing
Management
Medium Allocation
Transmit and Receive Message Data
Encapsulation
Media Independent Interface
Auto-Poll External PHY Status Polling
Described
Loopback Features
Medium Allocation
MII Management Frames
60, 61, 62
97, 98
70
71
71
72
70
70
71
72
70
71
71
70
A-2
43
36
36
37
37
39
39
52
47
40
41
50
47
43
42
50
43
42
42
42
60
63
61
61
60
61
62
60
78
76
69
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