參數(shù)資料
型號(hào)： AK4121
廠商： Asahi Kasei Microsystems Co.,Ltd
英文描述： ASYNCHRONOUS SAMPLE RATE CONVERTER
中文描述： 異步采樣率轉(zhuǎn)換器
文件頁(yè)數(shù)： 6/19頁(yè)
文件大?。?/td> 196K
代理商： AK4121
ASAHI KASEI
[AK4121]
MS0191-E-03
2004/08
- 6 -
SWITCHING CHARACTERISTICS
(Ta=
40
～
85
°
C; VDD=3.0~3.6V; TVDD=3.0~5.5V; C
L
=20pF)
Parameter
Master Clock Input (MCLK)
Frequency
Duty Cycle
L/R clock for Input data (ILRCK)
Frequency
Duty Cycle
L/R clock for Output data (OLRCK)
Frequency
Duty Cycle
Audio Interface Timing
Input
IBICK Period
IBICK Pulse Width Low
IBICK Pulse Width High
ILRCK Edge to IBICK “
↑
” (Note 9)
BICK “
↑
” to ILRCK Edge (Note 9)
SDTI Hold Time from IBICK “
↑
”
SDTI Setup Time to IBICK “
↑
”
Output (Slave Mode)
OBICK Period
OBICK Pulse Width Low
OBICK Pulse Width High
OLRCK Edge to OBICK “
↑
” (Note 9)
OBICK “
↑
” to OLRCK Edge (Note 9)
OLRCK to SDTO (MSB)
OBICK “
↓
” to SDTO
Output (Master Mode)
BICK Frequency
BICK Duty
BICK “
↓
” to LRCK
BICK “
↓
” to SDTO
Power-down & Reset Timing
PDN Pulse Width (Note 10)
Note 8. Min is 8kHz when BYPASS=“H”.
Note 9. BICK rising edge must not occur at the same time as LRCK edge.
Note 10. The AK4121 must be reset by bringing PDN “L” to “H” upon power-up.
Symbol
fCLK
dCLK
fs
Duty
fs
Duty
Duty
tBCK
tBCKL
tBCKH
tBLR
tLRB
tSDH
tSDS
tBCK
tBCKL
tBCKH
tBLR
tLRB
tLRS
tBSD
fBCK
dBCK
tMBLR
tBSD
tPD
min
8.192
40
8
48
32
48
1/64fs
65
65
30
30
30
30
1/64fs
65
65
30
30
20
20
150
typ
-
-
50
50
50
64fs
50
max
36.864
60
96
52
96
52
30
30
20
30
Units
MHz
%
kHz
%
kHz
%
%
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
Hz
%
ns
ns
ns
(Note 9)
Slave Mode
Master Mode
相關(guān)PDF資料
PDF描述
AK4125VF 192kHz / 24Bit High Performance Asynchronous SRC
AK4126VQ 6ch 192kHz / 24-Bit Asynchronous SRC
AK4126 digital sample rate converter.
AK4127 192kHz / 24Bit High Performance Asynchronous SRC
AK4127VF 192kHz / 24Bit High Performance Asynchronous SRC
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