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參數(shù)資料
| 型號： | ADV7393BCPZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 76/108頁 |
| 文件大小： | 0K |
| 描述： | IC DAC VIDEO HDTV 10BIT 40LFCSP |
| 產(chǎn)品變化通告： | ADV734x, ADV739x Feature Improvement |
| 設計資源： | Reconstruction Video Filter Using ADA4430-1 Amplifier After ADV7393 Video Encoder (CN0101) |
| 標準包裝： | 1 |
| 類型： | 視頻編碼器 |
| 應用： | 機頂盒，視頻播放器，顯示器 |
| 電壓 - 電源，模擬： | 2.6 V ~ 3.46 V |
| 電壓 - 電源，數(shù)字： | 1.71 V ~ 1.89 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 40-VFQFN 裸露焊盤，CSP |
| 供應商設備封裝： | 40-LFCSP-VQ（6x6） |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁面： | 786 (CN2011-ZH PDF) |
| 配用： | ADV7393-DBRDZ-ND - BOARD EVAL FOR ADV7393 EVAL-ADV7393EBZ-ND - BOARD EVAL FOR ADV7393 ENCODER |
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Data Sheet
ADV7390/ADV7391/ADV7392/ADV7393
Rev. G | Page 7 of 108
SPECIFICATIONS
POWER SUPPLY SPECIFICATIONS
All specifications TMIN to TMAX (40°C to +85°C), unless otherwise noted.
Table 3.
Parameter
Min
Typ
Max
Unit
SUPPLY VOLTAGES
VDD
1.71
1.8
1.89
V
VDD_IO
1.71
3.3
3.63
V
PVDD
1.71
1.8
1.89
V
VAA
2.6
3.3
3.465
V
POWER SUPPLY REJECTION RATIO
0.002
%/%
INPUT CLOCK SPECIFICATIONS
VDD = 1.71 V to 1.89 V, PVDD = 1.71 V to 1.89 V, VAA = 2.6 V to 3.465 V, VDD_IO = 1.71 V to 3.63 V.
All specifications TMIN to TMAX (40°C to +85°C), unless otherwise noted.
Table 4.
Parameter
Min
Typ
Max
Unit
fCLKIN
SD/ED
27
MHz
ED (at 54 MHz)
54
MHz
HD
74.25
MHz
CLKIN High Time, t9
40
% of one clock cycle
CLKIN Low Time, t10
40
% of one clock cycle
CLKIN Peak-to-Peak Jitter Tolerance
2
±ns
1
SD = standard definition, ED = enhanced definition (525p/625p), HD = high definition.
ANALOG OUTPUT SPECIFICATIONS
VDD = 1.71 V to 1.89 V, PVDD = 1.71 V to 1.89 V, VAA = 2.6 V to 3.465 V, VDD_IO = 1.71 V to 3.63 V.
All specifications TMIN to TMAX (40°C to +85°C), unless otherwise noted.
Table 5.
Parameter
Conditions
Min
Typ
Max
Unit
Full-Drive Output Current
RSET = 510 Ω, RL = 37.5 Ω
33
34.6
37
mA
All DACs enabled
RSET = 510 Ω, RL = 37.5 Ω
31.5
33.5
37
mA
Low-Drive Output Current
RSET = 4.12 kΩ, RL = 300 Ω
4.3
mA
DAC-to-DAC Matching
DAC 1, DAC 2, DAC 3
2.0
%
Output Compliance, VOC
0
1.4
V
Output Capacitance, COUT
10
pF
6
ns
DAC Analog Output Skew
DAC 1, DAC 2, DAC 3
1
ns
1
The recommended method of bringing this value back to the ideal value is by adjusting Register 0x0B to the recommended value of 0x12.
2
Output delay measured from the 50% point of the rising edge of the input clock to the 50% point of the DAC output full-scale transition.
相關PDF資料 |
PDF描述 |
|---|---|
| VE-B7H-IW-B1 | CONVERTER MOD DC/DC 52V 100W |
| VE-B74-IX-B1 | CONVERTER MOD DC/DC 48V 75W |
| VE-B74-IW-B1 | CONVERTER MOD DC/DC 48V 100W |
| VE-B73-IX-B1 | CONVERTER MOD DC/DC 24V 75W |
| VE-B72-IX-B1 | CONVERTER MOD DC/DC 15V 75W |
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參數(shù)描述 |
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| ADV7393WBCPZ | 制造商:Analog Devices 功能描述:LOW POWER, CHIP SCALE 10-BIT SD/HD VIDEO ENCODER - Trays |
| ADV7393WBCPZ-REEL | 制造商:Analog Devices 功能描述:LOW POWER, CHIP SCALE 10-BIT SD/HD VIDEO ENCODER - Tape and Reel |
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