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參數(shù)資料
| 型號： | ADV7171KSUZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 33/64頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DAC VIDEO ENC NTSC 44TQFP |
| 產(chǎn)品培訓(xùn)模塊： | Interfacing AV Converters to Blackfin Processors |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 類型： | 視頻編碼器 |
| 應(yīng)用： | 機(jī)頂盒，視頻播放器 |
| 電壓 - 電源，模擬： | 4.75 V ~ 5.25 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 44-TQFP |
| 供應(yīng)商設(shè)備封裝： | 44-TQFP（10x10） |
| 包裝： | 托盤 |
| 產(chǎn)品目錄頁面： | 786 (CN2011-ZH PDF) |
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ADV7170/ADV7171
Rev. C | Page 39 of 64
75
Ω
75
Ω
75
Ω
75
Ω
150
Ω
5k
Ω
5k
Ω
5V (VCC)
100
Ω
100
Ω
MPU BUS
10, 19, 21,
29, 43
27
DAC D
26
DAC C
31
DAC B
32
DAC A
23
SCLOCK
24
SDATA
34
RSET
1, 11, 20, 28, 30
VAA
ADV7170/
ADV7171
25
COMP
33
VREF
35
SCRESET/RTC
15
HSYNC
16
FIELD/VSYNC
17
BLANK
22
RESET
37
TTX
36
TTXREQ
44
CLOCK
P15–P0
38–42,
2–9, 12–14
18
ALSB
GND
5V (VAA)
0.1
μF
0.1
μF
UNUSED
INPUTS
SHOULD BE
GROUNDED
10k
Ω
5V (VAA)
27MHz CLOCK
(SAME CLOCK AS USED BY
MPEG2 DECODER)
TELETEXT PULL-UP AND
PULL-DOWN RESISTORS
SHOULD ONLY BE USED
IF THESE PINS ARE NOT
CONNECTED
100nF
5V (VAA)
4k
Ω
5V (VCC)
100k
Ω
100k
Ω
RESET
TTX
TTXREQ
POWER SUPPLY DECOUPLING
FOR EACH POWER SUPPLY GROUP
0.1
μF
0.01
μF
10
μF
5V (VAA)
L1
(FERRITE BEAD)
33
μF
5V
VCC
GND
S-VIDEO
00221-054
Figure 54. Recommended Analog Circuit Layout
The circuit in Figure 55 can be used to generate a 13.5 MHz waveform using the 27 MHz clock and the HSYNC pulse. This waveform is
guaranteed to produce the 13.5 MHz clock in synchronization with the 27 MHz clock. This 13.5 MHz clock can be used if a 13.5 MHz
clock is required by the MPEG decoder. This guarantees that the Cr and Cb pixel information is input to the ADV7170/ADV7171 in the
correct sequence.
D
Q
CK
D
Q
CK
CLOCK
HSYNC
13.5MHz
00221-055
Figure 55. Circuit to Generate 13.5 MHz
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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| ADV7171KSZ | 制造商:Analog Devices 功能描述:IC, VIDEO ENCODER, 10BIT, MQFP-44 |
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| ADV7171SU | 制造商:AD 制造商全稱:Analog Devices 功能描述:Digital PAL/NTSC Video Encoder with 10-Bit SSAF⑩ and Advanced Power Management |
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