ADuC7128/ADu" />
參數(shù)資料
型號(hào)： ADUC7128BCPZ126-RL
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 88/92頁(yè)
文件大?。?/td> 0K
描述： IC DAS MCU ARM7 ADC/DDS 64-LFCSP
產(chǎn)品培訓(xùn)模塊： ARM7 Applications & Tools
Intro to ARM7 Core & Microconverters
Direct Digital Synthesis Tutorial Series (1 of 7): Introduction
標(biāo)準(zhǔn)包裝： 1
系列： MicroConverter® ADuC7xxx
核心處理器： ARM7
芯體尺寸： 16/32-位
速度： 41.78MHz
連通性： I²C，SPI，UART/USART
外圍設(shè)備： PLA，POR，PWM，PSM，溫度傳感器，WDT
輸入/輸出數(shù)： 28
程序存儲(chǔ)器容量： 126KB（63K x 16）
程序存儲(chǔ)器類型： 閃存
RAM 容量： 8K x 8
電壓 - 電源 (Vcc/Vdd)： 3 V ~ 3.6 V
數(shù)據(jù)轉(zhuǎn)換器： A/D 10x12b; D/A 1x10b
振蕩器型： 內(nèi)部
工作溫度： -40°C ~ 125°C
封裝/外殼： 64-LFQFN 裸露焊盤(pán)，CSP
包裝： 標(biāo)準(zhǔn)包裝
配用： EVAL-ADUC7128QSPZ-ND - KIT DEV FOR ADUC7128
其它名稱： ADUC7128BCPZ126-RLDKR
ADuC7128/ADuC7129
Rev. 0 | Page 89 of 92
POWER-ON RESET OPERATION
An internal power-on reset (POR) is implemented on the
ADuC7128/ADuC7129. For LVDD below 2.45 V, the internal
POR holds the ADuC7128/ADuC7129 in reset. As LVDD rises
above 2.45 V, an internal timer times out for typically 64 ms
before the part is released from reset. The user must ensure that
the power supply, IOVDD, has reached a stable 3.0 V minimum
level by this time. On power-down, the internal POR holds the
ADuC7128/ADuC7129 in reset until LVDD has dropped below
2.45 V. Figure 72 illustrates the operation of the internal POR
in detail.
IOVDD
3.3V
2.6V
2.4V TYP
64ms TYP
LVDD
POR
MRST
0.12ms TYP
06
02
0-
06
2
Figure 72. Internal Power-On Reset Operation
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PDF描述
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