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參數資料
| 型號： | ADSP-BF526KBCZ-4C2 |
| 廠商： | Analog Devices Inc |
| 文件頁數： | 8/36頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSP CTRLR 400MHZ 289CSPBGA |
| 標準包裝： | 1 |
| 系列： | Blackfin® |
| 類型： | 定點 |
| 接口： | DMA，以太網，I²C，PPI，SPI，SPORT，UART，USB |
| 時鐘速率： | 400MHz |
| 非易失內存： | ROM（32 kB） |
| 芯片上RAM： | 132kB |
| 電壓 - 輸入/輸出： | 1.8V，2.5V，3.3V |
| 電壓 - 核心： | 1.30V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 289-LFBGA，CSPBGA |
| 供應商設備封裝： | 289-CSPBGA（12x12） |
| 包裝： | 托盤 |
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Rev. A
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March 2010
ADSP-BF522C/ADSP-BF523C/ADSP-BF524C/ADSP-BF525C/ADSP-BF526C/ADSP-BF527C
BIT DESCRIPTIONS
Table 4 through Table 14 on Page 20 describe each bit in the
control registers.
Table 4. Register 0 Left-Channel ADC Input Volume
Bit Name
Bits
Description
Settings
LRINBOTH
B8
Left-to-right line input ADC
data load control
0 = disable simultaneous loading of left-channel
ADC data to right-channel register (default)
1 = enable simultaneous loading of left-channel
ADC data to right-channel register
LINMUTE
B7
Left-channel input mute
0 = disable mute
1 = enable mute on data path to ADC (default)
LINVOL
B[5:0]
Left-channel PGA volume control
00 0000 = –34.5 dB
… 1.5 dB step up
01 0111 = 0 dB (default)
… 1.5 dB step up
01 1111 = 12 dB
10 0000 = 13.5 dB
10 0001 = 15 dB
10 0010 = 16.5 dB
10 0011 = 18 dB
10 0100 = 19.5 dB
10 0101 = 21 dB
10 0110 = 22.5 dB
10 0111 = 24 dB
10 1000 = 25.5 dB
10 1001 = 27 dB
10 1010 = 28.5 dB
10 1011 = 30 dB
10 1100 = 31.5 dB
10 1101 = 33 dB
11 1111 to 10 1101 = 33 dB
相關PDF資料 |
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