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參數(shù)資料
| 型號： | ADSP-BF526KBCZ-4C2 |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 19/36頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DSP CTRLR 400MHZ 289CSPBGA |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 系列： | Blackfin® |
| 類型： | 定點(diǎn) |
| 接口： | DMA，以太網(wǎng)，I²C，PPI，SPI，SPORT，UART，USB |
| 時(shí)鐘速率： | 400MHz |
| 非易失內(nèi)存： | ROM（32 kB） |
| 芯片上RAM： | 132kB |
| 電壓 - 輸入/輸出： | 1.8V，2.5V，3.3V |
| 電壓 - 核心： | 1.30V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 289-LFBGA，CSPBGA |
| 供應(yīng)商設(shè)備封裝： | 289-CSPBGA（12x12） |
| 包裝： | 托盤 |
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Rev. A
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March 2010
ADSP-BF522C/ADSP-BF523C/ADSP-BF524C/ADSP-BF525C/ADSP-BF526C/ADSP-BF527C
SPI Timing
Table 18. SPI Timing
Parameter
Test Conditions1 Min Max Unit
tDSU
CSDA to CSCL setup time
20
ns
tDHO
CSCL to CSDA hold time
20
ns
tSCH
CSCL pulse width high
20
ns
tSCL
CSCL pulse width low
20
ns
tSCS
CSCL rising edge to CSB rising edge
60
ns
tCSS
CSB rising to CSCL rising
20
ns
tCSH
CSB pulse width high
20
ns
tCSL
CSB pulse width low
20
ns
tPS
Pulse width of spikes to be suppressed
0
5
ns
1 AVDD, HPVDD, VDDEXT = 3.3 V, AGND = 0 V, TA = +25°C, Slave Mode, fS = 48 kHz, XTI/CODEC_MCLK = 256 × fS unless otherwise stated.
Figure 19. SPI Timing
CSB
CSCL
CSDA
t
CSL
t
CSH
t
DHO
t
CSS
t
DSU
t
SCS
t
SCL
t
SCH
相關(guān)PDF資料 |
PDF描述 |
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