JTAG Test And Emulation Port Timing Table 22 and Figure 24 describe JTAG port operations. Table 22. JTAG Port Timing Par" />
參數(shù)資料
型號： ADSP-2191MKSTZ-160
廠商： Analog Devices Inc
文件頁數(shù)： 33/48頁
文件大?。?/td> 0K
描述： IC DSP CONTROLLER 16BIT 144LQFP
標準包裝： 1
系列： ADSP-21xx
類型： 定點
接口： 主機接口，SPI，SSP，UART
時鐘速率： 160MHz
非易失內(nèi)存： 外部
芯片上RAM： 160kB
電壓 - 輸入/輸出： 3.00V，3.30V
電壓 - 核心： 2.50V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 144-LQFP
供應(yīng)商設(shè)備封裝： 144-LQFP（20x20）
包裝： 托盤
–39–
REV. A
ADSP-2191M
JTAG Test And Emulation Port Timing
Table 22 and Figure 24 describe JTAG port operations.
Table 22. JTAG Port Timing
Parameter
Min
Max
Unit
Switching Characteristics
t
DTDO
TDO Delay from TCK Low
8
ns
t
DSYS
System Outputs Delay After TCK Low1
022
ns
Timing Requirements
t
TCK
TCK Period
20
ns
t
STAP
TDI, TMS Setup Before TCK High
4
ns
t
HTAP
TDI, TMS Hold After TCK High
4
ns
t
SSYS
System Inputs Setup Before TCK Low2
4ns
t
HSYS
System Inputs Hold After TCK Low2
5ns
t
TRSTW
TRST Pulsewidth3
4t
TCK
ns
1System Outputs = DATA15–0, ADDR21–0, MS3–0, RD, WR, ACK, CLKOUT, BG, PF7–0, TIMEXP, DT0, DT1, TCLK0, TCLK1, RCLK0, RCLK1,
TFS0, TFS1, RFS0, RFS1,
BMS.
2System Inputs = DATA15–0, ADDR21–0, RD, WR, ACK, BR, BG, PF7–0, DR0, DR1, TCLK0, TCLK1, RCLK0, RCLK1, TFS0, TFS1, RFS0, RFS1,
CLKIN,
RESET.
350 MHz max.
Figure 24. JTAG Port Timing
TMS
TDI
TDO
SYSTEM
INPUTS
SYSTEM
OUTPUTS
TCK
tTCK
tHTAP
tSTAP
tDTDO
tSSYS
tHSYS
tDSYS
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