Programmable Flags Cycle Timing Table 10 and Figure 9 describe Programmable Flag operations. Timer PWM_OUT Cycle Timi" />
參數(shù)資料
型號(hào)： ADSP-2191MKSTZ-160
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 14/48頁(yè)
文件大?。?/td> 0K
描述： IC DSP CONTROLLER 16BIT 144LQFP
標(biāo)準(zhǔn)包裝： 1
系列： ADSP-21xx
類型： 定點(diǎn)
接口： 主機(jī)接口，SPI，SSP，UART
時(shí)鐘速率： 160MHz
非易失內(nèi)存： 外部
芯片上RAM： 160kB
電壓 - 輸入/輸出： 3.00V，3.30V
電壓 - 核心： 2.50V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 144-LQFP
供應(yīng)商設(shè)備封裝： 144-LQFP（20x20）
包裝： 托盤
–21–
REV. A
ADSP-2191M
Programmable Flags Cycle Timing
Table 10 and Figure 9 describe Programmable Flag operations.
Timer PWM_OUT Cycle Timing
Table 11 and Figure 10 describe timer expired operations. The
input signal is asynchronous in “width capture mode” and has
an absolute maximum input frequency of 40 MHz.
Table 10. Programmable Flags Cycle Timing
Parameter
Min
Max
Unit
Switching Characteristics
t
DFO
Flag Output Delay with Respect to CLKOUT
7
ns
t
HFO
Flag Output Hold After CLKOUT High
6
ns
Timing Requirement
t
HFI
Flag Input Hold is Asynchronous
3
ns
Figure 9. Programmable Flags Cycle Timing
PF
(INPUT)
tHFI
PF
(OUTPUT)
CLKOUT
FLAG INPUT
tDFO
tHFO
FLAG OUTPUT
Table 11. Timer PWM_OUT Cycle Timing
Parameter
Min
Max
Unit
Switching Characteristic
t
HTO
Timer Pulsewidth Output
1
12.5
(2
32 –1) cycles
ns
1The minimum time for t
HTO is one cycle, and the maximum time for tHTO equals (2
32 –1) cycles.
Figure 10. Timer PWM_OUT Cycle Timing
HCLK
PWM_OUT
tHTO
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