Timing Requirements: tCKI C" />
參數(shù)資料
型號： ADSP-2181KSZ-160
廠商： Analog Devices Inc
文件頁數(shù)： 6/32頁
文件大小： 0K
描述： IC DSP CONTROLLER 16BIT 128-PQFP
標(biāo)準(zhǔn)包裝： 1
系列： ADSP-21xx
類型： 定點
接口： 同步串行端口（SSP）
時鐘速率： 40MHz
非易失內(nèi)存： 外部
芯片上RAM： 80kB
電壓 - 輸入/輸出： 5.00V
電壓 - 核心： 5.00V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 128-BFQFP
供應(yīng)商設(shè)備封裝： 128-MQFP（14x20）
包裝： 托盤
REV. D
ADSP-2181
–14–
Parameter
Min
Max
Unit
Clock Signals and Reset
Timing Requirements:
tCKI
CLKIN Period
50
150
ns
tCKIL
CLKIN Width Low
20
ns
tCKIH
CLKIN Width High
20
ns
Switching Characteristics:
tCKL
CLKOUT Width Low
0.5tCK – 7
ns
tCKH
CLKOUT Width High
0.5tCK – 7
ns
tCKOH
CLKIN High to CLKOUT High
0
20
ns
Control Signals
Timing Requirement:
tRSP
RESET Width Low
5tCK
1
ns
NOTE
1Applies after power-up sequence is complete. Internal phase lock loop requires no more than 2000 CLKIN cycles assuming stable CLKIN (not including crystal
oscillator start-up time).
tCKOH
tCKI
tCKIH
tCKIL
tCKH
tCKL
tMH
tMS
CLKIN
CLKOUT
PF(2:0)
*
RESET
*PF2 IS MODE C, PF1 IS MODE B, PF0 IS MODE A
Figure 8. Clock Signals
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PDF描述
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