參數(shù)資料
型號(hào)： ADSP-21477KCPZ-1A
廠商： Analog Devices Inc
文件頁數(shù)： 44/76頁
文件大?。?/td> 0K
描述： IC DSP SHARC 200MHZ LP 88LFCSP
標(biāo)準(zhǔn)包裝： 1
系列： SHARC®
類型： 浮點(diǎn)
接口： DAI，DPI，I²C，SPI，SPORT，UART/USART
時(shí)鐘速率： 200MHz
芯片上RAM： 2Mb
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.20V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 88-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 88-LFCSP-VQ（12x12）
包裝： 托盤
Rev. C
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July 2013
Sample Rate Converter—Serial Input Port
The ASRC input signals are routed from the DAI_P20–1 pins
using the SRU. Therefore, the timing specifications provided in
Table 41 are valid at the DAI_P20–1 pins.
Table 41. ASRC, Serial Input Port
Parameter
Min
Max
Unit
Timing Requirements
tSRCSFS
1
Frame Sync Setup Before Serial Clock Rising Edge
4
ns
tSRCHFS
1
Frame Sync Hold After Serial Clock Rising Edge
5.5
ns
tSRCSD
1
Data Setup Before Serial Clock Rising Edge
4
ns
tSRCHD
1
Data Hold After Serial Clock Rising Edge
5.5
ns
tSRCCLKW
Clock Width
(tPCLK × 4) ÷ 2 – 1
ns
tSRCCLK
Clock Period
tPCLK × 4
ns
1 The serial clock, data, and frame sync signals can come from any of the DAI pins. The serial clock and frame sync signals can also come via PCG or SPORTs. PCG’s input
can be either CLKIN or any of the DAI pins.
Figure 28. ASRC Serial Input Port Timing
DAI_P20–1
(SCLK)
SAMPLE EDGE
DAI_P20–1
(FS)
DAI_P20–1
(SDATA)
tSRCCLK
tSRCCLKW
tSRCSFS
tSRCHFS
tSRCHD
tSRCSD
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PDF描述
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