參數(shù)資料
型號： ADSP-21477KCPZ-1A
廠商： Analog Devices Inc
文件頁數(shù)： 39/76頁
文件大小： 0K
描述： IC DSP SHARC 200MHZ LP 88LFCSP
標準包裝： 1
系列： SHARC®
類型： 浮點
接口： DAI，DPI，I²C，SPI，SPORT，UART/USART
時鐘速率： 200MHz
芯片上RAM： 2Mb
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.20V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 88-VFQFN 裸露焊盤，CSP
供應商設備封裝： 88-LFCSP-VQ（12x12）
包裝： 托盤
Rev. C
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July 2013
Table 36. Serial Ports—External Late Frame Sync
88-Lead LFCSP Package
All Other Packages
Unit
Parameter
Min
Max
Min
Max
Switching Characteristics
tDDTLFSE
1
Data Delay from Late External Transmit Frame Sync or
External Receive Frame Sync with MCE = 1, MFD = 0
2 × tPCLK
13.5
ns
tDDTENFS
1
Data Enable for MCE = 1, MFD = 0
0.5
ns
1 The tDDTLFSE and tDDTENFS parameters apply to left-justified as well as DSP serial mode, and MCE = 1, MFD = 0.
Figure 23. External Late Frame Sync1
1 This figure reflects changes made to support left-justified mode.
DRIVE
SAMPLE
EXTERNAL RECEIVE FS WITH MCE = 1, MFD = 0
2ND BIT
DAI_P20–1
(SCLK)
DAI_P20–1
(FS)
DAI_P20–1
(DATA CHANNEL
A/B)
1ST BIT
DRIVE
tDDTE/I
tHDTE/I
tDDTLFSE
tDDTENFS
tSFSE/I
DRIVE
SAMPLE
LATE EXTERNAL TRANSMIT FS
2ND BIT
DAI_P20–1
(SCLK)
DAI_P20–1
(FS)
DAI_P20–1
(DATA CHANNEL
A/B)
1ST BIT
DRIVE
tDDTE/I
tHDTE/I
tDDTLFSE
tDDTENFS
tSFSE/I
tHFSE/I
相關PDF資料
PDF描述
TAP106K035BRS CAP TANT 10UF 35V 10% RADIAL
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相關代理商/技術參數(shù)
參數(shù)描述
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