參數(shù)資料
型號(hào)： ADSP-21477KCPZ-1A
廠商： Analog Devices Inc
文件頁數(shù)： 26/76頁
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描述： IC DSP SHARC 200MHZ LP 88LFCSP
標(biāo)準(zhǔn)包裝： 1
系列： SHARC®
類型： 浮點(diǎn)
接口： DAI，DPI，I²C，SPI，SPORT，UART/USART
時(shí)鐘速率： 200MHz
芯片上RAM： 2Mb
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.20V
工作溫度： 0°C ~ 70°C
安裝類型： 表面貼裝
封裝/外殼： 88-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 88-LFCSP-VQ（12x12）
包裝： 托盤
Rev. C
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July 2013
Timer WDTH_CAP Timing
The following timing specification applies to timer0 and timer1,
and in WDTH_CAP (pulse width count and capture) mode.
Timer signals are routed to the DPI_P14–1 pins through the
SRU. Therefore, the timing specification provided below is valid
at the DPI_P14–1 pins.
Watchdog Timer Timing
Table 26. Timer Width Capture Timing
Parameter
Min
Max
Unit
Timing Requirement
tPWI
Timer Pulse Width
2 × tPCLK
2 × (231 – 1) × tPCLK
ns
Figure 14. Timer Width Capture Timing
TIMER
CAPTURE
INPUTS
tPWI
Table 27. Watchdog Timer Timing
Parameter
Min
Max
Unit
Timing Requirement
tWDTCLKPER
100
1000
ns
Switching Characteristics
tRST
WDT Clock Rising Edge to Watchdog Timer
RESET Falling Edge
37.6
ns
tRSTPW
Reset Pulse Width
64 × tWDTCLKPER
1
ns
1 When the internal oscillator is used, the 1/tWDTCLKPER varies from 1.5 MHz to 2.5 MHz and the WDT_CLKIN pin should be pulled low.
Figure 15. Watchdog Timer Timing
WDT_CLKIN
WDTRSTO
tWDTCLKPER
tRST
tRSTPW
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PDF描述
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參數(shù)描述
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