參數(shù)資料
型號： ADSP-21161NCCA-100
廠商： Analog Devices Inc
文件頁數(shù)： 26/60頁
文件大?。?/td> 0K
描述： IC DSP CONTROLLER 32BIT 225MBGA
產品培訓模塊： SHARC Processor Overview
標準包裝： 1
系列： SHARC®
類型： 浮點
接口： 主機接口，連接端口，串行端口
時鐘速率： 100MHz
非易失內存： 外部
芯片上RAM： 128kB
電壓 - 輸入/輸出： 3.30V
電壓 - 核心： 1.80V
工作溫度： -40°C ~ 105°C
安裝類型： 表面貼裝
封裝/外殼： 225-BGA，CSPBGA
供應商設備封裝： 225-CSPBGA（17x17）
包裝： 托盤
其它名稱： ADSP-21161NCCA100
Rev. C
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January 2013
Synchronous Read/Write — Bus Slave
Use these specifications for ADSP-21161N bus master accesses
of a slave’s IOP registers in multiprocessor memory space. The
bus master must meet these (bus slave) timing requirements.
Table 19. Synchronous Read/Write — Bus Slave
Parameter
Min
Max
Unit
Timing Requirements
tSADDI
Address, BRST Setup Before CLKIN
5
ns
tHADDI
Address, BRST Hold After CLKIN
1
ns
tSRWI
RD/WR Setup Before CLKIN
5
ns
tHRWI
RD/WR Hold After CLKIN
1
ns
tSSDATI
Data Setup Before CLKIN
5.5
ns
tHSDATI
Data Hold After CLKIN
1
ns
Switching Characteristics
tDDATO
Data Delay After CLKIN
12.5
ns
tHDATO
Data Hold After CLKIN
1.5
ns
tDACKC
ACK Delay After CLKIN
10
ns
tHACKO
ACK Hold After CLKIN
1.5
ns
Figure 20. Synchronous Read/Write — Bus Slave
CLKIN
ADDRESS
ACK
DATA
(OUT)
WRITE ACCESS
DATA
(IN)
READ ACCESS
tSADDI
tHADDI
tDACKC
tHACKO
tHRWI
tSRWI
tDDATO
tHDATO
tSRWI
tHRWI
tHSDATI
tSSDATI
RD
WR
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PDF描述
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