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參數(shù)資料
| 型號： | ADM1027ARQZ-RL7 |
| 廠商： | ON Semiconductor |
| 文件頁數(shù)： | 49/56頁 |
| 文件大?。?/td> | 1822K |
| 描述： | IC REMOTE THERMAL CTLR 24QSOP |
| 產(chǎn)品變化通告： | MFG CHG Notification ADI to ON Semi Product Discontinuation Notice 25/Aug/2008 Product Obsolescence 30/Sept/2009 |
| 標(biāo)準(zhǔn)包裝： | 1,000 |
| 系列： | dBCool® |
| 功能： | 風(fēng)扇控制，溫度監(jiān)控器 |
| 傳感器類型： | 內(nèi)部和外部 |
| 感應(yīng)溫度： | 0°C ~ 105°C，外部傳感器 |
| 精確度： | ±1°C |
| 拓撲： | ADC，比較器，風(fēng)扇速度計數(shù)器，多路復(fù)用器，寄存器庫 |
| 輸出類型： | SMBus? |
| 輸出警報： | 無 |
| 輸出風(fēng)扇： | 是 |
| 電源電壓： | 3 V ~ 5.5 V |
| 工作溫度： | 0°C ~ 105°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 24-SSOP（0.154"，3.90mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 24-QSOP |
| 包裝： | 帶卷 (TR) |
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REV. A
ADM1027
49
Table XIX. Register 0x63 Enhance Acoustics Register 2 (Power-On Default = 0x00)
Bit
Name
R/W
Description
<2:0>
ACOU3
Read/Write
These bits select the ramp rate applied to the PWM3 output. Instead of PWM3 jumping
instantaneously to its newly calculated speed, PWM3 will ramp gracefully at the rate
determined by these bits. This effect enhances the acoustics of the fan being driven by the
PWM3 output.
Time slot increase
Time for 33% to 100%
000 = 1
35 sec
001 = 2
17.6 sec
010 = 3
11.8 sec
011 = 5
7 sec
100 = 8
4.4 sec
101 = 12
3 sec
110 = 24
1.6 sec
111 = 48
0.8 sec
<3>
EN3
Read/Write
When this bit is 1, acoustic enhancement is enabled on PWM3 output. When acoustic
enhancement is enabled, fan spin-up time should be disabled.
<6:4>
ACOU2
Read/Write
These bits select the ramp rate applied to the PWM2 output. Instead of PWM2 jumping
instantaneously to its newly calculated speed, PWM2 will ramp gracefully at the rate
determined by these bits. This effect enhances the acoustics of the fans being driven by
the PWM2 output.
Time slot increase
Time for 33% to 100%
000 = 1
35 sec
001 = 2
17.6 sec
010 = 3
11.8 sec
011 = 5
7 sec
100 = 8
4.4 sec
101 = 12
3 sec
110 = 24
1.6 sec
111 = 48
0.8 sec
<7>
EN2
Read/Write
When this bit is 1, acoustic enhancement is enabled on PWM2 output. When acoustic
enhancement is enabled, fan spin-up time should be disabled.
This register becomes read-only when the Configuration Register 1 lock bit is set to 1. Any further attempts to write to this register
will have no effect.
Rev. 3 | Page 49 of 56 | www.onsemi.com
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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