參數(shù)資料
型號： ADF4351BCPZ
廠商： Analog Devices Inc
文件頁數(shù)： 20/28頁
文件大?。?/td> 0K
描述： IC SYNTH PLL VCO 32LFCSP
標(biāo)準(zhǔn)包裝： 1
類型： 扇出配送，分?jǐn)?shù)-N，整數(shù)-N，時鐘/頻率合成器（RF）
PLL： 是
輸入： CMOS，TTL
輸出： 時鐘
電路數(shù)： 1
比率 - 輸入:輸出： 1:3
差分 - 輸入:輸出： 無/無
頻率 - 最大： 4.4GHz
除法器/乘法器： 是/是
電源電壓： 3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 32-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 32-LFCSP（5x5）
包裝： 托盤
Data Sheet
ADF4351
Rev. 0 | Page 27 of 28
OUTPUT MATCHING
For optimum operation, the output of the ADF4351 can be
matched in a number of ways; the most basic method is to con-
nect a 50 resistor to VVCO. A dc bypass capacitor of 100 pF is
connected in series, as shown in Figure 37. Because the resistor
is not frequency dependent, this method provides a good broad-
band match. When connected to a 50 load, this circuit typically
gives a differential output power equal to the value selected by
Bits[DB4:DB3] in Register 4 (R4).
100pF
09800-
037
RFOUT
VVCO
50
Figure 37. Simple Output Stage
A better solution is to use a shunt inductor (acting as an RF choke)
to VVCO. This solution gives a better match and, therefore, more
output power.
Experiments have shown that the circuit shown in Figure 38
provides an excellent match to 50 for the W-CDMA UMTS
Band 1 (2110 MHz to 2170 MHz). The maximum output power
in this case is approximately 5 dBm. Both single-ended archi-
tectures can be examined using the EVAL-ADF4351EB1Z
evaluation board.
3.9nF
1nF
09800-
038
RFOUT
VVCO
50
Figure 38. Optimum Output Stage
If differential outputs are not needed, the unused output can be
terminated, or both outputs can be combined using a balun.
A balun using discrete inductors and capacitors can be imple-
mented with the architecture shown in Figure 39. The LC balun
comprises Component L1 and Component C1. L2 provides a dc
path for RFOUTA, and Capacitor C2 is used for dc blocking.
L1
C1
50
RFOUTA+
RFOUTA–
VVCO
C2
L2
09800-
039
Figure 39. LC Balun for the ADF4351
Table 8. LC Balun Components
Frequency
Range (MHz)
Inductor L1 (nH)
Capacitor C1 (pF)
RF Choke
Inductor L2 (nH)
DC Blocking
Capacitor C2 (pF)
Measured Output
Power (dBm)
137 to 300
100
10
390
1000
9
300 to 460
51
5.6
180
120
10
400 to 600
30
5.6
120
10
600 to 900
18
4
68
120
10
860 to 1240
12
2.2
39
10
9
1200 to 1600
5.6
1.2
15
10
9
1600 to 3600
3.3
0.7
10
8
2800 to 3800
2.2
0.5
10
8
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PDF描述
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ADF4355-2BCPZ-RL7 功能描述:IC INTEGRATED SYNTH/VCO 32LFCSP 制造商:analog devices inc. 系列:- 包裝:帶卷（TR） 零件狀態(tài):有效 類型:* PLL:是 輸入:時鐘 輸出:時鐘 電路數(shù):1 比率 - 輸入:輸出:1:2 差分 - 輸入:輸出:無/無 頻率 - 最大值:4.4GHz 分頻器/倍頻器:是/是 電壓 - 電源:3.15 V ~ 3.45 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:32-WFQFN 裸露焊盤，CSP 供應(yīng)商器件封裝:24-LFCSP-WQ（4x4） 標(biāo)準(zhǔn)包裝:1,500
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