參數資料
型號： ADF4150BCPZ-RL7
廠商： Analog Devices Inc
文件頁數： 23/28頁
文件大?。?/td> 0K
描述： IC PLL FREQ SYNTH 5.0GHZ 24LFCSP
標準包裝： 1,500
類型： 分數 N，整數 N，頻率合成器（RF）
PLL： 是
輸入： CMOS，TTL
輸出： 時鐘
電路數： 1
比率 - 輸入:輸出： 2:2
差分 - 輸入:輸出： 是/是
頻率 - 最大： 4.4GHz
除法器/乘法器： 是/無
電源電壓： 3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 24-WFQFN 裸露焊盤，CSP
供應商設備封裝： 24-LFCSP-WQ（4x4）
包裝： 帶卷 (TR)
ADF4150
Data Sheet
Rev. A | Page 4 of 28
Parameter
B Version
Unit
Conditions/Comments
Min
Typ
Max
RF OUTPUT CHARACTERISTICS
Minimum Output Frequency Using RF
Output Dividers
31.25
MHz
500 MHz VCO input and divide-by-16 selected
Maximum RFIN Frequency Using RF
Output Dividers
4400
MHz
Harmonic Content (Second)
19
dBc
Fundamental VCO output
Harmonic Content (Third)
13
dBc
Fundamental VCO output
Harmonic Content (Second)
20
dBc
Divided VCO output
Harmonic Content (Third)
10
dBc
Divided VCO output
Output Power 3
4
dBm
Maximum setting
+5
dBm
Minimum setting
Output Power Variation
±1
dB
Level of Signal With RF Mute Enabled
40
dBm
NOISE CHARACTERISTICS
Normalized Phase Noise Floor
(PNSYNTH)4
223
dBc/Hz
PLL loop BW = 500 kHz (ABP = 3 ns)
Normalized 1/f Noise (PN1_f)5
123
dBc/Hz
10 kHz offset. Normalized to 1 GHz. (ABP = 3 ns)
Normalized Phase Noise Floor
(PNSYNTH)4
222
dBc/Hz
PLL loop BW = 500 kHz (ABP = 6 ns); low noise
mode selected
Normalized 1/f Noise (PN1_f)5
119
dBc/Hz
10 kHz offset; normalized to 1 GHz; (ABP = 6 ns);
low noise mode selected
Spurious Signals Due to PFD
Frequency6
90
dBc
VCO output
75
dBc
RF output buffers
1
AC coupling ensures AVDD/2 bias.
2
TA = 25°C; AVDD = DVDD = 3.3 V; prescaler = 8/9; fREFIN = 100 MHz; fPFD = 26 MHz; fRF = 1.7422 GHz.
3
Using a tuned load.
4
The synthesizer phase noise floor is estimated by measuring the in-band phase noise at the output of the VCO and subtracting 20 log N (where N is the N divider
value) and 10 log FPFD. PNSYNTH = PNTOT 10logFPFD 20logN.
5
The PLL phase noise is composed of 1/f (flicker) noise plus the normalized PLL noise floor. The formula for calculating the 1/f noise contribution at an RF frequency (FRF)
and at a frequency offset (f) is given by PN = P1_f + 10log(10 kHz/f) + 20log(FRF/1 GHz). Both the normalized phase noise floor and flicker noise are modeled in ADIsimPLL.
6
Spurious measured on EVAL-ADF4150EB1Z, using a Rohde & Schwarz FSUP signal source analyzer.
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PDF描述
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