AVDD = DV
參數(shù)資料
型號： ADF4150BCPZ-RL7
廠商： Analog Devices Inc
文件頁數(shù)： 22/28頁
文件大?。?/td> 0K
描述： IC PLL FREQ SYNTH 5.0GHZ 24LFCSP
標準包裝： 1,500
類型： 分數(shù) N，整數(shù) N，頻率合成器（RF）
PLL： 是
輸入： CMOS，TTL
輸出： 時鐘
電路數(shù)： 1
比率 - 輸入:輸出： 2:2
差分 - 輸入:輸出： 是/是
頻率 - 最大： 4.4GHz
除法器/乘法器： 是/無
電源電壓： 3 V ~ 3.6 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 24-WFQFN 裸露焊盤，CSP
供應商設備封裝： 24-LFCSP-WQ（4x4）
包裝： 帶卷 (TR)
Data Sheet
ADF4150
Rev. A | Page 3 of 28
SPECIFICATIONS
AVDD = DVDD = SDVDD = 3.3 V ± 10%; VP = AVDD to 5.5 V; AGND = DGND = 0 V; TA = TMIN to TMAX, unless otherwise noted. The
operating temperature range is 40°C to +85°C.
Table 1.
Parameter
B Version
Unit
Conditions/Comments
Min
Typ
Max
REFIN CHARACTERISTICS
Input Frequency
10
250
MHz
For f < 10 MHz ensure slew rate > 21 V/s
Input Sensitivity
0.7
AVDD
V p-p
Biased at AVDD/21
Input Capacitance
5.0
pF
Input Current
±60
A
RF INPUT CHARACTERISTICS
RF Input Frequency (RFIN), RF Output
Buffer Disabled
0.5
4.0
GHz
10 dBm ≤ RF input power ≤ +5 dBm
RF Input Frequency (RFIN), RF Output
Buffer Disabled
0.5
5.0
GHz
5 dBm ≤ RF input power ≤ +5 dBm
RF Input Frequency (RFIN) RF Output
Buffer Enabled
0.5
3.5
GHz
10 dBm ≤ RF input power ≤ +5 dBm
RF Input Frequency (RFIN) RF Output
Buffer and Dividers Enabled
0.5
3.0
GHz
10 dBm ≤ RF input power ≤ +5 dBm
Prescaler Output Frequency
750
MHz
MAXIMUM PFD FREQUENCY
Fractional-N (Low Spur Mode)
26
MHz
Fractional-N Mode (Low Noise Mode)
32
MHz
Integer-N Mode
32
MHz
CHARGE PUMP
ICP Sink/Source
RSET = 5.1 kΩ
High Value
4.65
mA
Low Value
0.29
mA
RSET Range
2.7
10
kΩ
ICP Leakage
1
nA
VCP = VP/2
Sink and Source Current Matching
2
%
0.5 V ≤ VCP ≤ VP 0.5 V
ICP vs. VCP
1
%
0.5 V ≤ VCP ≤ VP 0.5 V
ICP vs. Temperature
2
%
VCP = VP/2
LOGIC INPUTS
Input High Voltage, VINH
1.5
V
Input Low Voltage, VINL
0.6
V
Input Current, IINH/IINL
±1
A
Input Capacitance, CIN
3.0
pF
LOGIC OUTPUTS
Output High Voltage, VOH
DVDD 0.4
V
CMOS output chosen
Output High Current, IOH
500
A
Output Low Voltage, VO
0.4
V
IOL = 500 A
POWER SUPPLIES
AVDD
3.0
3.6
V
DVDD, SDVDD
AVDD
VP
AVDD
5.5
V
DIDD + AIDD2
50
60
mA
Output Dividers
6 to 24
mA
Each output divide by two consumes 6 mA
IRFOUT2
24
32
mA
RF output stage is programmable
Low Power Sleep Mode
1
A
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