參數(shù)資料
型號： ADATE305BSVZ
廠商： Analog Devices Inc
文件頁數(shù)： 33/56頁
文件大?。?/td> 0K
描述： IC DCL ATE 250MHZ DUAL 100TQFP
標準包裝： 1
類型： DCL
應(yīng)用： 自動測試設(shè)備
安裝類型： 表面貼裝
封裝/外殼： 100-TQFP 裸露焊盤
供應(yīng)商設(shè)備封裝： 100-TQFP-EP（14x14）
包裝： 托盤
ADATE305
Rev. 0 | Page 39 of 56
REGISTER MAP
The ADDR[4:0] bits determine the destination register of the data being written to the ADATE305.
Table 20. Register Selection
DATA[15:0]
CH[1:0]
R/W
ADDR[4:0]
Register Selected
Reset State
N/A
0x00
NOP
N/A
DATA[13:0]
CH[1:0]
R/W
0x01
VH DAC level
4096d
DATA[13:0]
CH[1:0]
R/W
0x02
VL DAC level
4096d
DATA[13:0]
CH[1:0]
R/W
0x03
VT/VCOM DAC level
4096d
DATA[13:0]
CH[1:0]
R/W
0x04
VOL DAC level
4096d
DATA[13:0]
CH[1:0]
R/W
0x05
VOH DAC level
4096d
DATA[13:0]
CH[1:0]
R/W
0x06
VCH DAC level
4096d
DATA[13:0]
CH[1:0]
R/W
0x07
VCL DAC level
4096d
DATA[13:0]
CH[1:0]
R/W
0x08
V(IOH ) DAC level
4096d
DATA[13:0]
CH[1:0]
R/W
0x09
V(IOL ) DAC level
4096d
DATA[13:0]
CH[1]
R/W
0x0A
OVD high level
4096d
DATA[13:0]
CH[0]
R/W
0x0A
OVD low level
4096d
DATA[15:0]
CH[1:0]
R/W
0x0B
PMUDAC level
16384d
DATA[2:0]
CH[1:0]
R/W
0x0C
PE/PMU enable
000b
DATA[2:0]
CH[1:0]
R/W
0x0D
Channel state
000b
DATA[9:0]
CH[1:0]
R/W
0x0E
PMU state
0d
DATA[2:0]
CH[1:0]
R/W
0x0F
PMU measure enable
000b
DATA[0]
CH[1:0]
R/W
0x10
Differential comparator enable
0b
DATA[1:0]
CH[1:0]
R/W
0x11
16-bit DAC monitor
00b
DATA[1:0]
CH[1:0]
R/W
0x12
OVD_CHx alarm mask
01b
DATA[2:0]
CH[1:0]
R
0x13
OVD_CHx alarm state
N/A
0x14 to 0x1F
Reserved
N/A
1 N/A means not applicable.
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