參數(shù)資料
型號(hào)： AD9879BSZ
廠商： Analog Devices Inc
文件頁(yè)數(shù)： 32/32頁(yè)
文件大小： 0K
描述： IC PROCESSOR FRONT END 100MQFP
標(biāo)準(zhǔn)包裝： 1
位數(shù)： 12
通道數(shù)： 5
功率（瓦特）： 587mW
電壓 - 電源，模擬： 3.3V
電壓 - 電源，數(shù)字： 3.3V
封裝/外殼： 100-BQFP
供應(yīng)商設(shè)備封裝： 100-MQFP（14x20）
包裝： 托盤(pán)
AD9879
Rev. A | Page 9 of 32
Pin No.
Mnemonic
Description
41
SCLK
SPORT Clock.
42
CS
SPORT Chip Select.
43
SDIO
SPORT Data I/O.
44
SDO
SPORT Data Output.
45
DGNDTX
Tx Path Digital Ground.
46
DVDDTX
Tx Path Digital 3.3 V Supply.
47
PWRDN
Power-Down Transmit Path.
48
REFIO
TxDAC Decoupling (to AGND).
49
FSADJ
DAC Output Adjust (External Resistor).
50
AGNDTX
Tx Path Analog Ground.
51, 52
TX, TX+
Tx Path Complementary Outputs.
53
AVDDTX
Tx Path Analog 3.3 V Supply.
54
DGNDPLL
PLL Digital Ground.
55
DVDDPLL
PLL Digital 3.3 V Supply.
56
AVDDPLL
PLL Analog 3.3 V Supply.
57
PLLFILT
PLL Loop Filter Connection.
58
AGNDPLL
PLL Analog Ground.
59
DGNDOSC
Oscillator Digital Ground.
60
XTAL
Crystal Oscillator Inverted Output.
61
OSCIN
Oscillator Clock Input.
62
DVDDOSC
Oscillator Digital 3.3 V Supply.
63
CA_CLK
Serial Clock to Cable Driver.
64
CA_DATA
Serial Data to Cable Driver.
65
CA_EN
Serial Enable to Cable Drive.
66
DVDD Σ-
Σ- Digital 3.3 V Supply.
67
FLAG1
Digital Output Flag 1.
68
Σ-_OUT
Σ- DAC Output.
69
DGND Σ-
Σ- Digital Ground.
71
REFCLK
Programmable Reference Clock Output.
73
AVDDIQ
7-Bit ADCs Analog 3.3 V Supply.
74
AGNDIQ
7-Bit ADCs Analog Ground.
78, 79
I, I+
Differential Input to I ADC.
81, 82
Q, Q+
Differential Input to Q ADC.
83, 88, 91, 96, 99
AGND
12-Bit ADC Analog Ground.
84, 87, 92, 95
AVDD
12-Bit ADC Analog 3.3 V Supply.
85
REFB10
10-Bit ADC Decoupling Node.
86
REFT10
10-Bit ADC Decoupling Node.
89, 90
IF10, IF10+
Differential Input to 10-Bit ADC.
93
REFB12
12-Bit ADC Decoupling Node.
94
REFT12
12-Bit ADC Decoupling Node.
97, 98
IF12, IF12+
Differential Input to IF ADC.
100
VIDEO IN
Video Clamp Input, 12-Bit ADC.
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