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參數(shù)資料
型號(hào)： AD9847AKSTZRL
廠商： Analog Devices Inc
文件頁數(shù)： 23/28頁
文件大小： 0K
描述： IC CCD SIGNAL PROC 10BIT 48-LQFP
標(biāo)準(zhǔn)包裝： 2,000
類型： CCD 信號(hào)處理器，10 位
輸入類型： 邏輯
輸出類型： 邏輯
接口： 3 線串口
安裝類型： 表面貼裝
封裝/外殼： 48-LQFP
供應(yīng)商設(shè)備封裝： 48-LQFP（7x7）
包裝： 帶卷 (TR)
REV. A
AD9847
–4–
TIMING SPECIFICATIONS
Parameter
Symbol
Min
Typ
Max
Unit
MASTER CLOCK (CLI)
CLI Clock Period
tCLI
25
ns
CLI High/Low Pulsewidth
tADC
12.5
ns
Delay from CLI to Internal Pixel
Period Position
tCLIDLY
6ns
EXTERNAL MODE CLAMPING
CLPDM Pulsewidth
tCDM
410Pixels
CLPOB Pulsewidth
*
tCOB
220
Pixels
SAMPLE CLOCKS
SHP Rising Edge to SHD Rising Edge
tS1
10
ns
DATA OUTPUTS
Output Delay from Programmed Edge
tOD
6ns
Pipeline Delay
9
Cycles
SERIAL INTERFACE
Maximum SCK Frequency
fSCLK
10
MHz
SL to SCK Setup Time
tLS
10
ns
SCK to SL Hold Time
tLH
10
ns
SDATA Valid to SCK Rising Edge Setup
tDS
10
ns
SCK Falling Edge to SDATA Valid Hold
tDH
10
ns
SCK Falling Edge to SDATA Valid Read
tDV
10
ns
*Maximum CLPOB pulsewidth is for functional operation only. Wider typical pulses are recommended to achieve low noise clamp reference.
Specifications subject to change without notice.
(CL to 29 pF, fCLI = 40 MHz, Serial Timing in Figures 3a and 3b, unless otherwise noted.)
相關(guān)PDF資料
PDF描述
AD9849AKSTZRL IC CCD SIGNAL PROC 12BIT 48LQFP
AD9850BRS IC DDS DAC W/COMP 125MHZ 28-SSOP
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AD9852ASVZ IC DDS SYNTHESIZER CMOS 80-TQFP
AD9854ASTZ IC DDS QUADRATURE CMOS 80-LQFP
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參數(shù)描述
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