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參數(shù)資料
| 型號： | AD9779BSVZ |
| 廠商： | Analog Devices Inc |
| 文件頁數(shù)： | 22/56頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC DAC 16BIT DUAL 1GSPS 100TQFP |
| 產(chǎn)品培訓(xùn)模塊： | Data Converter Fundamentals DAC Architectures |
| 標準包裝： | 1 |
| 位數(shù)： | 16 |
| 數(shù)據(jù)接口： | 串行 |
| 轉(zhuǎn)換器數(shù)目： | 2 |
| 電壓電源： | 模擬和數(shù)字 |
| 功率耗散（最大）： | 300mW |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 100-TQFP 裸露焊盤 |
| 供應(yīng)商設(shè)備封裝： | 100-TQFP-EP（14x14） |
| 包裝： | 托盤 |
| 輸出數(shù)目和類型： | 4 電流，單極 |
| 采樣率（每秒）： | 1G |
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AD9776/AD9778/AD9779
Rev. A | Page 29 of 56
Address
Register Name
Reg. No.
Bits
Description
Function
Default
Sync Control Register
06
7:4
Sync input delay
See the Multiple DAC Synchronization
section for details on using these registers
to synchronize multiple DACs
0
06
3:0
Input sync pulse timing error
tolerance
0
07
7
Sync receiver enable
0
07
6
Sync driver enable
0
07
5
Sync triggering edge
0
07
4:0
SYNC_I to input data sampling
clock offset
0
PLL Control
08
7:2
PLL band select
VCO frequency range vs. PLL band select
value (see Table 18)
111001
08
1:0
VCO AGC gain control
Lower number (low gain) is generally better
for performance
11
09
7
PLL enable
0: PLL off, DAC rate clock supplied by
outside source
0
1: PLL on, DAC rate clock synthesized
internally from external reference clock via
PLL clock multiplier
09
6:5
PLL VCO divide ratio
FVCO/fDAC
00 × 1
01 × 2
10 × 4
11 × 8
09
4:3
PLL loop divide ratio
fDAC/fREF
00 × 2
01 × 4
10 × 8
11 × 16
09
2:0
PLL bias setting
Always set to 010
010
0A
7:5
PLL control voltage range
000 to 111, proportional to voltage at PLL
loop filter output, readback only
Misc Control
0A
4:0
PLL loop bandwidth adjustment
See PLL Loop Filter Bandwidth section for
details
I DAC Control Register
0B
7:0
I DAC gain adjustment
(7:0) LSB slice of 10-bit gain setting word
for I DAC
11111001
0C
7
I DAC sleep
0: I DAC on
0
1: I DAC off
0C
6
I DAC power-down
0: I DAC on
0
1: I DAC off
0C
1:0
I DAC gain adjustment
(9:8) MSB slice of 10-bit gain setting word
for I DAC
01
0D
7:0
Aux DAC1 gain adjustment
(7:0) LSB slice of 10-bit gain setting word for
Aux DAC1
00000000
0E
7
Aux DAC1 sign
0: positive
1: negative
0E
6
Aux DAC1 current direction
0: source
0
1: sink
0E
5
Aux DAC1 power-down
0: Aux DAC1 on
0
1: Aux DAC1 off
Aux DAC1 Control
Register
0E
1:0
Aux DAC1 gain adjustment
(9:8) MSB slice of 10-bit gain setting word
for Aux DAC1
00
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
|---|---|
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| AD9779BSVZRL | 功能描述:IC DAC 16BIT DUAL 1GSPS 100TQFP RoHS:是 類別:集成電路 (IC) >> 數(shù)據(jù)采集 - 數(shù)模轉(zhuǎn)換器 系列:- 產(chǎn)品培訓(xùn)模塊:Lead (SnPb) Finish for COTS Obsolescence Mitigation Program 標準包裝:1,000 系列:- 設(shè)置時間:1µs 位數(shù):8 數(shù)據(jù)接口:串行 轉(zhuǎn)換器數(shù)目:8 電壓電源:雙 ± 功率耗散（最大）:941mW 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:24-SOIC（0.295"，7.50mm 寬） 供應(yīng)商設(shè)備封裝:24-SOIC W 包裝:帶卷 (TR) 輸出數(shù)目和類型:8 電壓，單極 采樣率（每秒）:* |
| AD9779BSVZRL1 | 制造商:AD 制造商全稱:Analog Devices 功能描述:Dual 12-/14-/16-Bit, 1 GSPS, Digital-to-Analog Converters |
| AD9779-EB | 制造商:Analog Devices 功能描述:EVAL BOARD 16 BIT DUAL INTERPOLATION DAC - Bulk |
| AD9779-EBZ | 制造商:Analog Devices 功能描述:DUAL 16B, 1.0 GSPS TXDAC - Bulk |
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