Typical (typ) is given for VS = 3.3 V ± 5%; VS ≤ VCP ≤ 5.25 V; T" />
參數(shù)資料
型號： AD9522-5BCPZ-REEL7
廠商： Analog Devices Inc
文件頁數(shù)： 34/76頁
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描述： IC CLOCK GEN 2.4GHZ 64LFCSP
標(biāo)準(zhǔn)包裝： 750
類型： 時鐘發(fā)生器，扇出配送
PLL： 是
輸入： CMOS，LVDS，LVPECL
輸出： CMOS，LVDS，LVPECL
電路數(shù)： 1
比率 - 輸入:輸出： 2:12，2:24
差分 - 輸入:輸出： 是/是
頻率 - 最大： 2.4GHz
除法器/乘法器： 是/無
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -40°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 64-VFQFN 裸露焊盤，CSP
供應(yīng)商設(shè)備封裝： 64-LFCSP-VQ（9x9）
包裝： 帶卷 (TR)
AD9522-5
Rev. 0 | Page 4 of 76
SPECIFICATIONS
Typical (typ) is given for VS = 3.3 V ± 5%; VS ≤ VCP ≤ 5.25 V; TA = 25°C; RSET = 4.12 kΩ; CPRSET = 5.1 kΩ, unless otherwise noted. Minimum
(min) and maximum (max) values are given over full VS and TA (40°C to +85°C) variation.
POWER SUPPLY REQUIREMENTS
Table 1.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
VS
3.135
3.3
3.465
V
3.3 V ± 5%
VCP
VS
5.25
V
This is nominally 3.3 V to 5.0 V ± 5%
RSET Pin Resistor
4.12
kΩ
Sets internal biasing currents; connect to ground
CPRSET Pin Resistor
5.1
kΩ
Sets internal CP current range, nominally 4.8 mA (CP_lsb = 600 μA);
actual current can be calculated by CP_lsb = 3.06/CPRSET; connect to ground
PLL CHARACTERISTICS
Table 2.
Parameter
Min
Typ
Max
Unit
Test Conditions/Comments
REFERENCE INPUTS
Differential Mode (REFIN, REFIN)
Differential mode (can accommodate single-ended input
by ac grounding undriven input)
Input Frequency
0
250
MHz
Frequencies below about 1 MHz should be dc-coupled;
be careful to match VCM (self-bias voltage)
Input Sensitivity
280
mV p-p
Self-Bias Voltage, REFIN
1.35
1.60
1.75
V
Self-bias voltage of REFIN1
Self-Bias Voltage, REFIN
1.30
1.50
1.60
V
Self-bias voltage of REFIN1
Input Resistance, REFIN
4.0
4.8
5.9
kΩ
Self-biased1
Input Resistance, REFIN
4.4
5.3
6.4
kΩ
Self-biased1
Dual Single-Ended Mode (REF1, REF2)
Two single-ended CMOS-compatible inputs
Input Frequency (AC-Coupled with
DC Offset Off )
10
250
MHz
Slew rate must be > 50 V/μs
Input Frequency (AC-Coupled
with DC Offset On)
250
MHz
Slew rate must be > 50 V/μs, and input amplitude
sensitivity specification must be met; see input sensitivity
Input Frequency (DC-Coupled)
0
250
MHz
Slew rate > 50 V/μs; CMOS levels
Input Sensitivity (AC-Coupled
with DC Offset Off )
0.55
3.28
V p-p
VIH should not exceed VS
Input Sensitivity (AC-Coupled
with DC Offset On)
1.5
2.78
V p-p
VIH should not exceed VS
Input Logic High, DC Offset Off
2.0
V
Input Logic Low, DC Offset Off
0.8
V
Input Current
100
+100
μA
Input Capacitance
2
pF
Each pin, REFIN (REF1)/REFIN (REF2)
Crystal Oscillator
Crystal Resonator Frequency Range
16.62
33.33
MHz
Maximum Crystal Motional Resistance
30
Ω
PHASE/FREQUENCY DETECTOR (PFD)
PFD Input Frequency
100
MHz
Antibacklash pulse width = 1.3 ns, 2.9 ns
45
MHz
Antibacklash pulse width = 6.0 ns
Reference Input Clock Doubler Frequency
0.004
50
MHz
Antibacklash pulse width = 1.3 ns, 2.9 ns
Antibacklash Pulse Width
1.3
ns
0x017[1:0] = 01b
2.9
ns
0x017[1:0] = 00b; 0x017[1:0] = 11b
6.0
ns
0x017[1:0] = 10b
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PDF描述
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