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參數(shù)資料
| 型號： | AD6652 |
| 廠商： | Analog Devices, Inc. |
| 英文描述： | 12-Bit, 65 MSPS IF to Baseband Diversity Receiver |
| 中文描述： | 12位，65 MSPS的IF到基帶分集接收機(jī) |
| 文件頁數(shù)： | 66/76頁 |
| 文件大小： | 1839K |
| 代理商： | AD6652 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁當(dāng)前第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁
AD6652
Table 29. Memory Map for Output Port Control Regist
Address
Register
08
LHB A Control Register
09
LHB B Control Register
0A
AGC A Control Register
0B
AGC A Hold-Off Counter
0C
AGC A Desired Level
0D
AGC A Signal Gain
0E
AGC A Loop Gain
0F
AGC A Pole Location
10
AGC A Average Samples
11
AGC A Update Decimation
12
AGC B Control Register
Rev. 0 | Page 66 of 76
ers
Comments
3:
2–1:
0:
2:
1:
0:
7–5:
4:
3:
2:
1:
0:
15–0:
7–0:
11–0:
7–0:
7–-0:
5–2:
1–0:
11–0:
7–5:
4:
Bit Width
4
3
8
16
8
12
8
8
6
12
8
LHB A enable
1
LHB A signal interleaving
11
All 4 channels
10
Channels 0, 1, 2
01
Channels 0, 1
00
Channel 0
Bypass LHB A
1
LHB B enable
1
LHB B signal interleaving
1:
Channels 2, 3
0:
Channel 2
Bypass LHB B
1
Output word length
111
4 bits
110
5 bits
101
6 bits
100
7 bits
011
8 bits
010
10 bits
001
12 bits
000
16 bits
Clipping error
1:
Maintain level of clipping error
0:
Maintain output signal le
Sync now
Init on sync
First sync only
Bypass
Hold-off value
Desired output power level or clipping energy (R parameter)
Gs parameter
K parameter
P parameter
Scale for CIC decimator
Number of averaging samples
CIC decimation ratio
Output word length
111
4 bits
110
5 bits
101
6 bits
100
7 bits
011
8 bits
010
10 bits
001
12 bits
000
16 bits
Clipping error
1:
Maintain level of clipping error
0:
Maintain output signal level
vel
相關(guān)PDF資料 |
PDF描述 |
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