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參數(shù)資料
| 型號(hào)： | AD5378ABCZ |
| 廠商： | Analog Devices Inc |
| 文件頁(yè)數(shù)： | 27/29頁(yè) |
| 文件大?。?/td> | 0K |
| 描述： | IC DAC 14BIT 32CHAN 108CSPBGA |
| 產(chǎn)品培訓(xùn)模塊： | Data Converter Fundamentals DAC Architectures |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 設(shè)置時(shí)間： | 20µs |
| 位數(shù)： | 14 |
| 數(shù)據(jù)接口： | 串行，并聯(lián) |
| 轉(zhuǎn)換器數(shù)目： | 32 |
| 電壓電源： | 模擬和數(shù)字，雙 ± |
| 功率耗散（最大）： | 850mW |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 108-BGA，CSPBGA |
| 供應(yīng)商設(shè)備封裝： | 108-CSPBGA（13x13） |
| 包裝： | 托盤 |
| 輸出數(shù)目和類型： | 32 電壓，雙極 |
| 采樣率（每秒）： | 50k |
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AD5378
Rev. A | Page 6 of 28
TIMING CHARACTERISTICS
SERIAL INTERFACE
VCC = 2.7 V to 5.5 V; VDD = 11.4 V to 16.5 V; VSS = 11.4 V to 16.5 V; VREF(+) = +5 V; VREF() = 3.5 V;
AGND = DGND = REFGND = 0 V; VBIAS = 5 V, FIFOEN = 0 V; all specifications TMIN to TMAX, unless otherwise noted.
Table 5.
Parameter1, 2, 3
Limit at TMIN, TMAX
Unit
Description
t1
20
ns min
SCLK Cycle Time.
t2
8
ns min
SCLK High Time.
t3
8
ns min
SCLK Low Time.
t4
10
ns min
SYNC Falling Edge to SCLK Falling Edge Setup Time.
t54
15
ns min
24th SCLK Falling Edge to SYNC Falling Edge.
25
ns min
Minimum SYNC Low Time.
t7
10
ns min
Minimum SYNC High Time.
t8
5
ns min
Data Setup Time.
t9
4.5
ns min
Data Hold Time.
30
ns max
24th SCLK Falling Edge to BUSY Falling Edge.
t11
330
ns max
BUSY Pulse Width Low (Single-Channel Update). See Table 11.
t124
20
ns min
24th SCLK Falling Edge to LDAC Falling Edge.
t13
20
ns min
LDAC Pulse Width Low.
t14
150
ns typ
BUSY Rising Edge to DAC Output Response Time.
t15
0
ns min
BUSY Rising Edge to LDAC Falling Edge.
t16
100
ns min
LDAC Falling Edge to DAC Output Response Time.
t17
20/30
μs typ/max
DAC Output Settling Time.
t18
10
ns min
CLR Pulse Width Low.
t19
350
ns max
CLR/RESET Pulse Activation Time.
t206, 7
25
ns max
SCLK Rising Edge to SDO Valid.
t217
5
ns min
SCLK Falling Edge to SYNC Rising Edge.
t227
5
ns min
SYNC Rising Edge to SCLK Rising Edge.
t237
20
ns min
SYNC Rising Edge to LDAC Falling Edge.
t245
30
ns min
SYNC Rising Edge to BUSY Falling Edge.
t25
10
ns min
RESET Pulse Width Low.
t26
120
μs max
RESET Time Indicated by BUSY
Low.
1 Guaranteed by design and characterization; not production tested.
2 All input signals are specified with tr = tf = 2 ns (10% to 90% of VCC) and timed from a voltage level of 1.2 V.
4 Standalone mode only.
5 This is measured with the load circuit of Figure 2.
6 This is measured with the load circuit of Figure 3.
7 Daisy-chain mode only.
TO
OUTPUT
PIN
VCC
VOL
CL
50pF
RL
2.2k
05292-002
Figure 2. Load Circuit for BUSY Timing Diagram
2
VOH(min) + VOL(max)
200
A
200
A
IOL
IOH
CL
50pF
TO
OUTPUT
PIN
05292-003
Figure 3. Load Circuit for SDO Timing Diagram
(Serial Interface, Daisy-Chain Mode)
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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| AD5379 | 制造商:AD 制造商全稱:Analog Devices 功能描述:40-Channel, 14-Bit, Parallel and Serial Input, Bipolar Voltage-Output DAC |
| AD5379ABC | 功能描述:IC DAC 14BIT 40CH 108-CSPBGA RoHS:否 類別:集成電路 (IC) >> 數(shù)據(jù)采集 - 數(shù)模轉(zhuǎn)換器 系列:- 產(chǎn)品培訓(xùn)模塊:Lead (SnPb) Finish for COTS Obsolescence Mitigation Program 標(biāo)準(zhǔn)包裝:1,000 系列:- 設(shè)置時(shí)間:1µs 位數(shù):8 數(shù)據(jù)接口:串行 轉(zhuǎn)換器數(shù)目:8 電壓電源:雙 ± 功率耗散（最大）:941mW 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:24-SOIC（0.295"，7.50mm 寬） 供應(yīng)商設(shè)備封裝:24-SOIC W 包裝:帶卷 (TR) 輸出數(shù)目和類型:8 電壓，單極 采樣率（每秒）:* |
| AD5379ABCZ | 功能描述:IC DAC 14BIT 40CHAN 108CSPBGA RoHS:是 類別:集成電路 (IC) >> 數(shù)據(jù)采集 - 數(shù)模轉(zhuǎn)換器 系列:- 產(chǎn)品培訓(xùn)模塊:Lead (SnPb) Finish for COTS Obsolescence Mitigation Program 標(biāo)準(zhǔn)包裝:1,000 系列:- 設(shè)置時(shí)間:1µs 位數(shù):8 數(shù)據(jù)接口:串行 轉(zhuǎn)換器數(shù)目:8 電壓電源:雙 ± 功率耗散（最大）:941mW 工作溫度:0°C ~ 70°C 安裝類型:表面貼裝 封裝/外殼:24-SOIC（0.295"，7.50mm 寬） 供應(yīng)商設(shè)備封裝:24-SOIC W 包裝:帶卷 (TR) 輸出數(shù)目和類型:8 電壓，單極 采樣率（每秒）:* |
| AD537JCHIPS | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:Voltage-to-Frequency Converter |
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