參數(shù)資料
型號(hào)： 74LV175
廠商： NXP Semiconductors N.V.
英文描述： Quad D-type flip-flop with reset;positive-edge trigger(上升沿觸發(fā),帶復(fù)位的四D觸發(fā)器)
中文描述： 四D型觸發(fā)器的復(fù)位觸發(fā)器，積極邊緣觸發(fā)（上升沿觸發(fā)，帶復(fù)位的四?觸發(fā)器）
文件頁(yè)數(shù)： 3/13頁(yè)
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代理商： 74LV175
Philips Semiconductors
Product specification
74LV175
Quad D-type flip-flop with reset; positive-edge trigger
1998 May 20
3
LOGIC SYMBOL (IEEE/IEC)
SV00601
2
3
7
6
10
11
15
14
4
5
12
13
1D
C1
9
1
R
LOGIC SYMBOL
SV00600
Q0
Q0
Q1
Q1
Q2
Q2
Q3
Q3
D0
D1
D2
D3
CP
2
3
7
6
10
11
15
14
9
4
5
12
13
1
MR
FUNCTIONAL DIAGRAM
SV00602
FF0
to
FF3
Q0
Q0
Q1
Q1
Q2
Q2
Q3
Q3
D0
D1
D2
D3
CP
9
4
5
12
13
1
MR
2
3
7
6
10
11
15
14
LOGIC DIAGRAM
SV00603
CP
CP
CP
CP
CP
FF0
FF2
FF1
FF3
D
D0
D1
D2
D3
D
D
D
Q
Q0
Q1
Q2
Q3
Q3
Q2
Q1
Q0
Q
Q
Q
Q
Q
Q
Q
RD
MR
RD
RD
RD
FUNCTION TABLE
OPERATING MODES
INPUTS
OUTPUTS
MR
L
CP
X
↑
↑
D
n
X
Q
n
L
Q
n
H
Reset (clear)
Load ‘1’
H
h
H
L
Load ‘0’
NOTES:
H =
h
=
L
=
I
=
↑
=
X =
H
l
L
H
HIGH voltage level
HIGH voltage level one set-up time prior to the LOW-to-HIGH clock transition
LOW voltage level
LOW voltage level level one set-up time prior to the LOW-to-HIGH clock transition
LOW-to-HIGH clock transition
don’t care
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