參數(shù)資料
型號： 21555-AA
英文描述： Controller Miscellaneous - Datasheet Reference
中文描述： 控制器雜項-數(shù)據(jù)表參考
文件頁數(shù)： 24/30頁
文件大?。?/td> 485K
代理商： 21555-AA
Non-Transparent PPB
24
Datasheet
Table 8
and
Table 9
specify p_clk and s_clk parameter values for clock signal AC timing, and
Figure 4
shows the AC parameter measurements for the p_clk and s_clk signals. See also
Figure 5
for a further illustration of signal timing. Unless otherwise indicated, all AC parameters are
guaranteed when tested within the functional operating range of
Table 6
.
Table 8. 33 MHz PCI Clock Signal AC Parameters
Symbol
Parameter
Minimum
Maximum
Unit
T
cyc
p_clk,s_clk cycle time
30
∞
ns
T
high
p_clk, s_clk high time
11
—
ns
T
low
p_clk, s_clk low time
11
—
ns
–
p_clk, s_clk slew rate
a
a. 0.2 V
to 0.6 V
.
b. Required when the 21555 is operating in synchronous mode.
c.
Measured with 30 pF lumped load.
1
4
V/ns
T
sclk
Delay from p_clk to s_clk
b
3
15
ns
T
sclkr
p_clk rising to s_clk_o rising
0
8
ns
T
sclkf
p_clk falling to s_clk_o falling
c
0
8
ns
T
dskew
s_clk_o duty cycle skew from p_clk
duty cycle
C
—
0.75
ns
Table 9. 66 MHz PCI Clock Signal AC Parameters
Symbol
Parameter
Minimum
Maximum
Unit
T
cyc
p_clk,s_clk cycle time
15
30
ns
T
high
p_clk, s_clk high time
6
—
ns
T
low
p_clk, s_clk low time
6
—
ns
–
p_clk, s_clk slew rate
a
a. 0.2 V
to 0.6 V
.
b. Required when the 21555 is operating in synchronous mode.
c.
Measured with 30 pF lumped load.
1.5
4
V/ns
T
sclk
Delay from p_clk to s_clk
b
3
15
ns
T
sclkr
p_clk rising to s_clk_o rising
0
13
ns
T
sclkf
p_clk falling to s_clk_o falling
c
0
13
ns
T
dskew
s_clk_o duty cycle skew from p_clk
duty cycle
C
—
0.75
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