參數(shù)資料
型號(hào)： μPD784215Y
廠商： NEC Corp.
英文描述： 8/16 Bit RISC Microcontrollers(8/16位RISC微控制器)
中文描述： 8 / 16位RISC微控制器（8 / 16位的RISC微控制器）
文件頁(yè)數(shù)： 291/617頁(yè)
文件大?。?/td> 2471K
代理商： ΜPD784215Y
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CHAPTER 17 ASYNCHRONOUS SERIAL INTERFACE/3-WIRE SERIAL I/O
(1) Transmit shift registers (TXS1, TXS2)
These registers are used to set transmit data. Data written to TXS1 and TXS2 is sent as serial data.
If a data length of 7 bits is specified, bits 0 to 6 of the data written to TXS1 and TXS2 are transferred as transmit
data. Transmission is started by writing data to TXS1 and TXS2.
TX1 and TX2 can be written with an 8-bit memory manipulation instruction, but cannot be read.
RESET input sets TXS1 and TXS2 to FFH.
Caution
Do not write to TXS1 and TXS2 during transmission.
TXS1, TXS2 and receive buffer registers RXB1, RXB2 are allocated to the same address.
Therefore, attempting to read TXS1 and TXS2 will result in reading the values of RXB1 and
RXB2.
(2) Receive shift registers (RX1, RX2)
These registers are used to convert serial data input to the R
X
D1 and R
X
D2 pins to parallel data. Receive data
is transferred to the receive buffer register (RXB1, RSB2) one byte at a time as it is received.
RX1 and RX2 cannot be directly manipulated by program.
(3) Receive buffer registers (RXB1, RXB2)
These registers are used to hold receive data. Each time one byte of data is received, new receive data is
transferred from the receive shift registers (RX1, RX2)
If a data length of 7 bits is specified, receive data is transferred to bits 0 to 6 of RXB1 and RXB2, and the MSB
of RXB1 and RXB2 always becomes 0.
RXB1 and RXB2 can be read by an 8-bit memory manipulation instruction, but cannot be written.
RESET input sets RXB1 and RXB2 to FFH.
Caution
RXB1, RXB2 and transmit shift registers TXB1, TXB2 are allocated to the same address.
Therefore, attempting to read RXB1 and RXB2 will result in reading the values of TXB1 and
TXB2.
(4) Transmission control circuit
This circuit controls transmit operations such as the addition of a start bit, parity bit, and stop bit(s) to data written
to transmit shift registers (TXS1, TXS2), according to the contents set to the asynchronous serial interface mode
registers (ASIM1, ASIM2).
(5) Reception control circuit
This circuit controls reception according to the contents set to the asynchronous serial interface mode registers
(ASIM1, ASIM2). It also performs error check for parity errors, etc., during reception and transmission. If it detects
an error, it sets a value corresponding to the nature of the error in the asynchronous serial interface status registers
(ASIS1, ASIS2).
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