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參數(shù)資料
| 型號： | XRT83L34IVTR |
| 廠商： | Exar Corporation |
| 文件頁數(shù)： | 96/99頁 |
| 文件大?。?/td> | 0K |
| 描述： | IC LIU T1/E1/J1 QUAD 128TQFP |
| 標準包裝： | 750 |
| 類型： | 線路接口裝置（LIU） |
| 驅(qū)動器/接收器數(shù)： | 4/4 |
| 規(guī)程： | T1，E1，J1 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 128-LQFP |
| 供應商設備封裝： | 128-TQFP（14x20） |
| 包裝： | 帶卷 (TR) |
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XRT83L34
xr
REV. 1.0.1
QUAD T1/E1/J1 LH/SH TRANSCEIVER WITH CLOCK RECOVERY AND JITTER ATTENUATOR
93
MOTOROLA ASYCHRONOUS INTERFACE TIMING
The signals used in the Motorola microprocessor interface mode are: Address Strobe (AS), Data Strobe (DS),
Read/Write Enable (R/W), Chip Select (CS), Address and Data bits. The interface is compatible with the timing
of a Motorola 68000 microprocessor family. The interface timing is shown in Figure 35 and Figure 36. The I/O
specifications are shown in Table 51.
FIGURE 35. MOTOROLA 68K ASYNCHRONOUS PROGRAMMED I/O INTERFACE TIMING
TABLE 51: ASYNCHRONOUS - MOTOROLA 68K - INTERFACE TIMING SPECIFICATION
SYMBOL
PARAMETER
MIN
MAX
UNITS
t0
Valid Address to CS Falling Edge
0
-
ns
t1
CS Falling Edge to DS Assert
65
-
ns
t2
DS Assert to DTACK Assert
-
50
ns
NA
DS Pulse Width (t2)
50
-
ns
t3
CS Falling Edge to AS Falling Edge
0
-
ns
Reset pulse width - both Motorola and Intel Operations (see
t9
Reset pulse width
30
FIGURE 36. MICROPROCESSOR INTERFACE TIMING - RESET PULSE WIDTH
CS
A D D R [6:0 ]
D A T A [7:0]
RD_DS
WR _R /W
R D Y_DT AC K
V a lid D ata fo r R eadb ack
D ata A va ilable to W rite In to the LIU
READ O P E RAT IO N
W RIT E O P E RAT IO N
t
0
t
0
t
1
t
2
Valid Addres s
Valid Address
t
3
t
3
t
1
t
2
A LE_AS
Reset
t
9
相關PDF資料 |
PDF描述 |
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