- 您現(xiàn)在的位置：買(mǎi)賣(mài)IC網(wǎng) > PDF目錄376460 > XRT7234 (Exar Corporation) E3 ATM User Network Interface(E3異步傳輸模式用戶(hù)網(wǎng)絡(luò)接口) PDF資料下載
參數(shù)資料
| 型號(hào)： | XRT7234 |
| 廠(chǎng)商： | Exar Corporation |
| 英文描述： | E3 ATM User Network Interface(E3異步傳輸模式用戶(hù)網(wǎng)絡(luò)接口) |
| 中文描述： | E3展自動(dòng)柜員機(jī)用戶(hù)網(wǎng)絡(luò)接口（E3展異步傳輸模式用戶(hù)網(wǎng)絡(luò)接口） |
| 文件頁(yè)數(shù)： | 46/318頁(yè) |
| 文件大?。?/td> | 2088K |
| 代理商： | XRT7234 |
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XRT7234
E3 UNI FOR ATM
x r
PRELIMINARY
REV. P1.0.0
52
Bit 6—One Second Interrupt Enable
This “Read/Write” bit-field allows the user to enable or disable the “One Second” Interrupt, that is automatically generated
by the UNI device, once for each second.
Writing a “0” to this bit-field disables this interrupt. Conversely, writing a “1” to this bit-field enables the “One-
Second” interrupt.
Bit 5—Tx E3 Framer Interrupt Enable
This “Read/Write” bit-field allows the user to disable the “Transmit E3 Framer block” related interrupt, or to enable
this interrupt, that has been enabled via the “Tx E3 LAPD Status/Interrupt” Register (Address = 3Fh).
Writing a “0” to this bit-field disables the “Transmit E3 Framer block” related interrupt (independent of the enable/
disable status of this interrupt within the “Tx E3 LAPD Status/Interrupt” Register). Writing a “1” to this bit-field
enables this interrupt provided that it has already been enabled via the “Tx E3 LAPD Status/Interrupt” register.
Bit 4—Rx E3 Framer Interrupt Enable
This “Read/Write” bit-field allows the user to globally disable all “Receive E3 Framer” block interrupts; or to enable
those “Receive E3 Framer” interrupts that are enabled via “Rx E3 Interrupt Enable Register-1” (Address = 10h), or
the “Rx E3 Interrupt Enable Register -2” (Address = 11h).
Writing a “0” to this bit-field disables ALL “Receive E3 Framer” block interrupts (independent of the enable/disable
status of these interrupts within these other registers). Writing a “1” to this bit-field enables those “Receive E3
Framer” interrupt that have already been enabled via these other registers.
Bit 3—Tx CP Interrupt Enable
This “Read/Write” bit-field allows the user to disable the “Transmit Cell Processor block” related interrupt, or to
enable this interrupt, that has been enabled via the “Tx CP Control/Interrupt” Register (Address = 72h).
Writing a “0” to this bit-field disables the “Transmit Cell Processor block” related interrupt (independent of the
enable/disable status of this interrupt within the “Tx CP Control/Interrupt” Register). Writing a “1” to this bit-field
enables this interrupt, provided it has been enabled within the “Tx CP Control/Interrupt” Register.
Bit 5—Rx CP Interrupt Enable
This “Read/Write” bit-field allows the user to globally disable all “Receive Cell Processor block” interrupts; or to
enables those interrupts that have been enabled via the “Rx CP Interrupt Enable” Register (Address = 60h).
Writing a “0” to this bit-field disables ALL “Receive Cell Processor block” interrupts (independent of the enable/dis-
able status of these interrupts via the “Rx CP Interrupt Enable” Register). Writing a “1” to this bit-field enables those
“Receive Cell Processor block” interrupt that have already been enabled via the “Rx CP Interrupt Enable” Register.
Bit 1—Tx Utopia Interrupt Enable
This “Read/Write” bit-field allows the user to globally disable all “Transmit Utopia Interface block” interrupts; or to
enable those interrupts that have been enabled via the “Tx Utopia Interrupt Enable/Status” Register (Address = 80h).
Writing a “0” to this bit-field disables ALL “Transmit Utopia Interface block” interrupts (independent of the enable/disable
status of these interrupts within the “Tx Utopia Interrupt Enable/Status” Register). Writing a “1” to this bit-field
enables those “Transmit Utopia Interface block” interrupts that have already been enabled via the “Tx Utopia Interrupt
Enable/Status” Register.
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