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參數(shù)資料
| 型號： | VS6724 |
| 廠商： | 意法半導(dǎo)體 |
| 英文描述： | 2 Megapixel single-chip camera module |
| 中文描述： | 兩百萬像素的單芯片相機(jī)模塊 |
| 文件頁數(shù)： | 33/118頁 |
| 文件大?。?/td> | 1200K |
| 代理商： | VS6724 |
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VS6724
Functional description
33/118
Prevention of false synchronization codes
The VS6724 is able to prevent the output of 0xFF and/or 0x00 data from being
misinterpreted by a host system as the start of synchronization data. This function is
controlled the bCodeCheckEnable register.
2.10.2
Mode 1 (ITU656 compatible)
The structure of an image frame with ITU656 codes is shown in
Figure 18
.
Figure 18.
ITU656 frame structure with even codes
The synchronization codes for odd and even frames are listed in
Table 3
and
Table 4
. By
default all frames output from the VS6724 are EVEN. It is possible to set all frames to be
ODD or to alternate between ODD and EVEN using the SyncCodeSetup register in
the
Dither control
register bank.
Table 3.
ITU656 embedded synchronization code definition (even frames)
Name
Description
4-byte sequence
SAV
Line start - active
FF 00 00 80
EAV
Line end - active
FF 00 00 9D
SAV (blanking)
Line start - blanking
FF 00 00 AB
EAV (blanking)
Line end - blanking
FF 00 00 B6
EAV
9D
SAV
80
Frame of image data
Line 1
Line 480
Frame blanking period
L
EAV
B6
SAV
AB
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| VS8002LC | Logic IC |
| VS8001FC | Logic IC |
| VS8001FI | Logic IC |
| VS8001LC | Logic IC |
| VS8001LI | Logic IC |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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| VS6725 | 制造商:STMICROELECTRONICS 制造商全稱:STMicroelectronics 功能描述:2 megapixel single-chip camera module |
| VS6725Q045 | 制造商:STMicroelectronics 功能描述: |
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