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參數(shù)資料
| 型號： | VOICE-RECORD-RD |
| 廠商： | Silicon Laboratories Inc |
| 文件頁數(shù)： | 107/270頁 |
| 文件大?。?/td> | 0K |
| 描述： | KIT REF DESIGN VOICE RECORD F41X |
| 標(biāo)準(zhǔn)包裝： | 1 |
| 主要目的： | 音頻，語音錄制/回放 |
| 嵌入式： | 是，MCU，8 位 |
| 已用 IC / 零件： | C8051F411-GM |
| 主要屬性： | MCU，87 秒，8 kHz， |
| 次要屬性： | 需要 Keil 編譯器和 USB 調(diào)試適配器 |
| 已供物品： | 板，電池，CD，耳機(jī)，電源 |
| 相關(guān)產(chǎn)品： | 336-1317-ND - KIT EVAL FOR C8051F411 |
| 其它名稱： | 336-1315 |
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Rev. 1.1
195
C8051F410/1/2/3
SMBus configuration options include:
Timeout detection (SCL Low Timeout and/or Bus Free Timeout)
SDA setup and hold time extensions
Slave event enable/disable
Clock source selection
These options are selected in the SMB0CF register, as described in Section “21.4.1. SMBus Configura-
21.4.1. SMBus Configuration Register
The SMBus Configuration register (SMB0CF) is used to enable the SMBus Master and/or Slave modes,
select the SMBus clock source, and select the SMBus timing and timeout options. When the ENSMB bit is
set, the SMBus is enabled for all master and slave events. Slave events may be disabled by setting the
INH bit. With slave events inhibited, the SMBus interface will still monitor the SCL and SDA pins; however,
the interface will NACK all received addresses and will not generate any slave interrupts. When the INH bit
is set, all slave events will be inhibited following the next START (interrupts will continue for the duration of
the current transfer).
Table 21.1. SMBus Clock Source Selection
The SMBCS1-0 bits select the SMBus clock source, which is used only when operating as a master or
when the Bus Free Timeout detection is enabled. When operating as a master, overflows from the selected
source determine the absolute minimum SCL low and high times as defined in Equation 21.1. Note that the
selected clock source may be shared by other peripherals so long as the timer is left running at all times.
For example, Timer 1 overflows may generate the SMBus and UART baud rates simultaneously. Timer
configuration is covered in
T
HighMin
T
LowMin
1
f
ClockSourceOverflow
----------------------------------------------
==
Equation 21.1. Minimum SCL High and Low Times
The selected clock source should be configured to establish the minimum SCL High and Low times as per
Equation 21.1. When the interface is operating as a master (and SCL is not driven or extended by any
other devices on the bus), the typical SMBus bit rate is approximated by Equation 21.2.
BitRate
f
ClockSourceOverflow
3
----------------------------------------------
=
Equation 21.2. Typical SMBus Bit Rate
SMBCS1
SMBCS0
SMBus Clock Source
0
Timer 0 Overflow
0
1
Timer 1 Overflow
1
0
Timer 2 High Byte Overflow
1
Timer 2 Low Byte Overflow
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