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參數(shù)資料
| 型號： | TMX320DM647ZUT900 |
| 廠商： | Texas Instruments, Inc. |
| 英文描述： | Digital Media Processor |
| 中文描述： | 數(shù)字媒體處理器 |
| 文件頁數(shù)： | 98/166頁 |
| 文件大?。?/td> | 1341K |
| 代理商： | TMX320DM647ZUT900 |
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www.ti.com
P
6.10.3 EMIFA Electrical Data/Timing
AECLKIN
2
3
4
4
5
1
TMS320DM647/TMS320DM648
Digital Media Processor
SPRS372–MAY 2007
Table 6-29. Timing Requirements for AECLKIN for EMIFA
(1)(2)
(see
Figure 6-13
)
-720
-900
NO.
UNIT
MIN
6
(3)
2.7
2.7
MAX
1
2
3
4
5
t
c(EKI)
t
w(EKIH)
t
w(EKIL)
t
t(EKI)
t
J(EKI)
Cycle time, AECLKIN
Pulse duration, AECLKIN high
Pulse duration, AECLKIN low
Transition time, AECLKIN
Period Jitter, AECLKIN
40
ns
ns
ns
ns
ns
2
0.02E
(4)
(1)
(2)
(3)
The reference points for the rise and fall transitions are measured at V
MAX and V
IH
MIN.
E = the EMIF input clock (AECLKIN or SYSCLK4) period in ns for EMIFA.
Minimum AECLKIN cycle times
must
be met, even when AECLKIN is generated by an internal clock source. Minimum AECLKIN times
are based on internal logic speed; the maximum useable speed of the EMIF may be lower due to AC timing requirements.
This timing applies only when AECLKIN is used for EMIFA.
(4)
Figure 6-13. AECLKIN Timing for EMIFA
Peripheral Information and Electrical Specifications
98
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