參數資料
型號： TMS320LF2402PGEA
廠商： Texas Instruments, Inc.
元件分類： 數字信號處理
英文描述： DSP CONTROLLERS
中文描述： DSP控制器
文件頁數： 77/115頁
文件大?。?/td> 1511K
代理商： TMS320LF2402PGEA
SPRS094I APRIL 1999 REVISED SEPTEMBER 2003
77
POST OFFICE BOX 1443
HOUSTON, TEXAS 772511443
interrupt timings
INT refers to XINT1 and XINT2. PDP refers to PDPINTx.
switching characteristics over recommended operating conditions (see Figure 32)
PARAMETER
MIN
MAX
UNIT
td(PDP-PWM)HZ
Delay time, PDPINTx low to PWM high-impedance state
12
ns
td(INT)
Delay time, INT low/high to interrupt-vector fetch
10tc(CO)
ns
timing requirements [H = 0.5t
c(CO)
] (see Figure 32)
MIN
NOM
MAX
UNIT
tw(INT)
tw(PDP)
To maintain compatibility with 240xA and other future devices, it is suggested that PDPINTx be driven low for a minimum of 7 or 13 CLKOUT
cycles. See SPRS145 for more details.
Pulse duration, INT input low/high
2H+15
ns
Pulse duration, PDPINTx input low
4H+5
ns
To maintain compatibility with 240xA and other future devices, it is suggested that PDPINTx be driven low for a minimum of
7 or 13 CLKOUT cycles. See SPRS145 for more details.
PWM refers to
all
the PWM pins in the device (i.e., PWMn and TnPWM pins). The state of the PWM pins after PDPINTx is
taken high depends on the state of the FCOMPOE bit.
PWM
PDPINTx
CLKOUT
tw(PDP)
td(PDP-PWM)HZ
XINT1, XINT2
tw(INT)
Interrupt Vector
td(INT)
Address Bus
Figure 32. External Interrupts Timing
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