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參數(shù)資料
| 型號(hào)： | TMS320C6454GTZ |
| 廠商： | Texas Instruments, Inc. |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | Fixed-Point Digital Signal Processor |
| 中文描述： | 定點(diǎn)數(shù)字信號(hào)處理器 |
| 文件頁(yè)數(shù)： | 155/225頁(yè) |
| 文件大?。?/td> | 1663K |
| 代理商： | TMS320C6454GTZ |
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www.ti.com
P
TMS320C6454
Fixed-Point Digital Signal Processor
SPRS311A–APRIL 2006–REVISED DECEMBER 2006
7.10.3.2
Programmable Synchronous Interface Timing
Table 7-46. Timing Requirements for Programmable Synchronous Interface Cycles for EMIFA Module
(see
Figure 7-36
)
-720
-850
-1000
MIN
2
1.5
NO.
UNIT
MAX
6
7
t
su(EDV-EKOH)
t
h(EKOH-EDV)
Setup time, read AEDx valid before AECLKOUT high
Hold time, read AEDx valid after AECLKOUT high
ns
ns
Table 7-47. Switching Characteristics Over Recommended Operating Conditions for Programmable
Synchronous Interface Cycles for EMIFA Module
(1)
(see
Figure 7-36
–
Figure 7-38
)
-720
-850
-1000
MIN
1.3
NO.
PARAMETER
UNIT
MAX
4.9
4.9
1
2
3
4
5
8
9
10
11
12
t
d(EKOH-CEV)
t
d(EKOH-BEV)
t
d(EKOH-BEIV)
t
d(EKOH-EAV)
t
d(EKOH-EAIV)
t
d(EKOH-ADSV)
t
d(EKOH-OEV)
t
d(EKOH-EDV)
t
d(EKOH-EDIV)
t
d(EKOH-WEV)
The following parameters are programmable via the EMIFA CE Configuration registers (CEnCFG):
Read latency (R_LTNCY): 0-, 1-, 2-, or 3-cycle read latency
Write latency (W_LTNCY): 0-, 1-, 2-, or 3-cycle write latency
ACEx assertion length (CE_EXT): For standard SBSRAM or ZBT SRAM interface, ACEx goes inactive after the final command has
been issued (CE_EXT = 0). For synchronous FIFO interface with glue, ACEx is active when ASOE is active (CE_EXT = 1).
Function of ASADS/ASRE (R_ENABLE): For standard SBSRAM or ZBT SRAM interface, ASADS/ASRE acts as ASADS with
deselect cycles (R_ENABLE = 0). For FIFO interface, ASADS/ASRE acts as ASRE with NO deselect cycles (R_ENABLE = 1).
Delay time, AECLKOUT high to ACEx valid
Delay time, AECLKOUT high to ABEx valid
Delay time, AECLKOUT high to ABEx invalid
Delay time, AECLKOUT high to AEAx valid
Delay time, AECLKOUT high to AEAx invalid
Delay time, AECLKOUT high to ASADS/ASRE valid
Delay time, AECLKOUT high to ASOE valid
Delay time, AECLKOUT high to AEDx valid
Delay time, AECLKOUT high to AEDx invalid
Delay time, AECLKOUT high to ASWE valid
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
1.3
4.9
1.3
1.3
1.3
4.9
4.9
4.9
1.3
1.3
4.9
(1)
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C64x+ Peripheral Information and Electrical Specifications
155
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PDF描述 |
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