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參數(shù)資料
| 型號： | TMS320C4X |
| 廠商： | Texas Instruments, Inc. |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | Digital Signal Processing Solutions |
| 中文描述： | 數(shù)字信號處理方案 |
| 文件頁數(shù)： | 28/726頁 |
| 文件大小： | 1771K |
| 代理商： | TMS320C4X |
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Figures
xxv
Contents
5–12
Extended-Precision Floating-Point Format Conversion to
Single-Precision Floating-Point Format
IEEE Single-Precision Std. 754 Floating-Point Format
’C4x Single-Precision Twos-Complement Floating-Point Format
Flowchart for Floating-Point Multiplication
Flowchart for Floating-Point Addition
Flowchart for NORM Instruction Operation
Flowchart for Floating-Point Rounding by the RND Instruction
Flowchart for Floating-Point-to-Integer Conversion by FIX Instruction
Flowchart for Integer-to-Floating-Point Conversion by FLOAT Instructions
RCPF Instruction Algorithm
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RSQRF Instruction Algorithm
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Direct Addressing
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Indirect Addressing Operand Encoding
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Encoding for 24-Bit PC-Relative Addressing Mode
Encoding for General Addressing Modes
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Encoding for Type 1 Three-Operand Addressing Modes (’C3x and ’C4x)
Encoding for Type 2 Three-Operand Addressing Modes (’C4x Only)
Encoding for Parallel Multiply With ADD/SUB
Encoding for Conditional-Branch Addressing Modes
Register Relationships in Circular Addressing
Circular Buffer Implementation
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Circular Addressing Example
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Data Structure for FIR Filters
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CALL Response Timing
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Interrupt-Vector Table (IVT)
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IIF Register Modification
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CPU Interrupt Processing
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Flow of Traps
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Trap Vector Table (TVT)
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DMA Interrupt Processing
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Parallel CPU and DMA Interrupt Processing
Pipeline Structure
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Two-Operand Instruction Word
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Three-Operand Instruction Word
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Multiply or CPU Operation With a Parallel Store
Two Parallel Stores
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Parallel Multiplies and Adds
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Global and Local Memory Interface Control Signals
Location of the Memory-Interface Control Registers
Fields in the Memory-Interface Control Registers
Effects of STRB ACTIVE on Global Memory Bus Memory Map
STRBx PAGESIZE Fields Example
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STRB and RDY Timing
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PDF描述 |
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參數(shù)描述 |
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