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參數(shù)資料
| 型號(hào)： | TLC320AD55CDW |
| 廠商： | TEXAS INSTRUMENTS INC |
| 元件分類： | 模擬信號(hào)調(diào)理 |
| 英文描述： | SPECIALTY ANALOG CIRCUIT, PDSO28 |
| 封裝： | PLASTIC, SOP-28 |
| 文件頁(yè)數(shù)： | 30/41頁(yè) |
| 文件大?。?/td> | 203K |
| 代理商： | TLC320AD55CDW |
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A–2
Table A– 3. Control 2 Register
D7
D6
D5
D4
D3
D2
D1
D0
DESCRIPTION
X
–
Reserved
–
X
–
Decimator FIR overflow flag (valid only during read cycle)
–
X
–
FLAG 1 output value
–
X
–
FLAG 0 output value
–
1
–
Phone mode enabled
–
0
–
Phone mode disabled
–
0
–
Normal operation with decimator FIR filter
–
1
–
Bypass decimator FIR filter
–
0
Normal operation with interpolator filter
–
1
Bypass interpolator FIR filter
Default register value: 00000000
Writing zeros to the reserved bits is suggested.
Table A– 4. Fk Divide Register
D7
D6
D5
D4
D3
D2
D1
D0
DIVIDE VALUE
1
255
1
000
0000
128
0
010
0000
32
0
000
0001
1
0
256
Default register value: 00001000
The oversampling clock (FCLK) is set as MCLK/(Fk
× 4). MCLK/(Fk × 256) is the sample frequency
(conversion rate) for the converter. When Fk is programmed to zero, its value is interpreted as 256.
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| TLC320AD55CDWR | SPECIALTY ANALOG CIRCUIT, PDSO28 |
| TLC320AD57CDW | 1-CH 18-BIT DELTA-SIGMA ADC, SERIAL ACCESS, PDSO28 |
| TLC320AD57CDWR | 1-CH 18-BIT DELTA-SIGMA ADC, SERIAL ACCESS, PDSO28 |
| TLC320AD58CDWR | 2-CH 18-BIT DELTA-SIGMA ADC, SERIAL ACCESS, PDSO28 |
| TLC320AD58CDW | 2-CH 18-BIT DELTA-SIGMA ADC, SERIAL ACCESS, PDSO28 |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| TLC320AD56 | 制造商:TI 制造商全稱:Texas Instruments 功能描述:Sigma-Delta Analog Interface Circuit |
| TLC320AD56C | 制造商:TI 制造商全稱:Texas Instruments 功能描述:Sigma-Delta Analog Interface Circuit |
| TLC320AD56CFN | 制造商:Rochester Electronics LLC 功能描述:- Bulk 制造商:Texas Instruments 功能描述: |
| TLC320AD56CPT | 制造商:Rochester Electronics LLC 功能描述:- Bulk 制造商:Texas Instruments 功能描述: |
| TLC320AD57 | 制造商:TI 制造商全稱:Texas Instruments 功能描述:Sigma-Delta Stereo Analog-to-Digital Converter |
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