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參數(shù)資料
| 型號(hào)： | TDA9910HW/8/C1 |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類(lèi)： | ADC |
| 英文描述： | 1-CH 12-BIT RESISTANCE LADDER ADC, PARALLEL ACCESS, PQFP48 |
| 封裝： | 7 X 7 MM, 1 MM HEIGHT, PLASTIC, SOT545-2, MS-026, HTQFP-48 |
| 文件頁(yè)數(shù)： | 2/21頁(yè) |
| 文件大?。?/td> | 128K |
| 代理商： | TDA9910HW/8/C1 |
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TDA9910_4
NXP B.V. 2007. All rights reserved.
Product data sheet
Rev. 04 — 12 June 2007
10 of 21
NXP Semiconductors
TDA9910
12-bit, up to 80 Msample/s, Analog-to-Digital Converter (ADC)
[1]
X = don’t care.
Table 6.
Output coding with differential inputs
Vi(IN) Vi(INN) = 1.9 V; VFSIN =VCCA1 1.87 V; typical values to AGND.
Code
Vi(IN) (V) Vi(INN) (V) IR
Binary outputs
(D11 to D0)
Two’s complement outputs
(D11 to D0)
Underow
< 2.675
> 3.625
0
0000 0000 0000
1000 0000 0000
0
2.675
3.625
1
0000 0000 0000
1000 0000 0000
1
-
1
0000 0000 0001
1000 0000 0001
...
2047
3.15
1
0111 1111 1111
1111 1111 1111
...
4094
-
1
1111 1111 1110
0111 1111 1110
4095
3.625
2.675
1
1111 1111 1111
0111 1111 1111
Overow
> 3.625
< 2.675
0
1111 1111 1111
0111 1111 1111
Table 7.
Mode selection
Two’s complement output (OTC) Chip enable input (CE_N) Data output (D0 to D11; IR)
0
binary; active
1
0
two’s complement; active
1
high-impedance
Fig 3.
Output timing diagram
IN
CLK
0.5 V
n
D0 to D11
VCCO 0.5 V
50 %
data
n
1
data
n
data
n
+ 1
td(o)
td(s)
th(o)
001aaa513
sample
n
sample
n
+ 1
sample
n
+ 2
sample
n
+ 3
sample
n
+ 4
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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