參數(shù)資料
型號： TDA5230
廠商： INFINEON TECHNOLOGIES AG
元件分類： 消費家電
英文描述： SPECIALTY CONSUMER CIRCUIT, PDSO28
封裝： GREEN, PLASTIC, TSSOP-28
文件頁數(shù)： 29/186頁
文件大?。?/td> 3820K
代理商： TDA5230
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TDA523x
Functional Description
Data Sheet
120
Version 4.0, 2007-06-01
2.4.17
Interrupt Generation Unit
The Interrupt Generation Unit receives all possible interrupts and sets the NINT signal
based on the configuration of the Interrupt Mask register (IM). The Interrupt Status
register is set from the Interrupt Generation Unit, depending on which interrupt occurred.
The polarity of the interrupt that is routed to the NINT/NSTR Pin is defined in the CMC1
register. Please note that during power up and brown out reset, the polarity of the
NINT/NSTR Pin is always as described in Chapter 2.4.2 Chip Reset.
A Reset Event has the highest priority. It sets all bits in the Status register to “1” and sets
the Interrupt Pin to “0”. The first interrupt after the Reset Event will clear the Status
register and will set the Interrupt Pin to “1”, even if this interrupt is masked.
A wake up interrupt clears the FsyncA, FsyncB and the complementary wake up Flag. A
Fsync Interrupt clears the EOMA, EOMB, MIDA, MIDB and the complementary Fsync
Flag.
The Interrupt Status register is always cleared after it is read via SPI.
It is not possible to disable the Power On Reset Indicator Interrupt using the Interrupt
Mask register.
Figure 64
Interrupt Generation Unit
IS
Interrupt-Mask
Interrupt-Signalling
IM
Data Clock
Wa
k
e
U
p
C
fg
A
EO
M
C
fg
A
Me
s
ag
e
ID
Cfg
A
FS
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A
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C
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B
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ID
Cfg
B
FS
y
n
cC
fg
B
Pow
e
r-
U
p
/Br
o
w
n
O
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t
NINTPOL
D
a
ta
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Reset
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B
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cB
MI
D
B
EO
M
A
WU
A
F
S
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cA
MI
D
A
PIN Function
from Digital
Receiver
NINT
NINT/NSTR Pin
NINTNSTRSEL
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