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參數(shù)資料
| 型號： | TDA5230 |
| 廠商： | INFINEON TECHNOLOGIES AG |
| 元件分類： | 消費家電 |
| 英文描述： | SPECIALTY CONSUMER CIRCUIT, PDSO28 |
| 封裝： | GREEN, PLASTIC, TSSOP-28 |
| 文件頁數(shù)： | 14/186頁 |
| 文件大?。?/td> | 3820K |
| 代理商： | TDA5230 |
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TDA523x
Functional Description
Data Sheet
106
Version 4.0, 2007-06-01
Figure 54
Clock Recovery GAP Re-synchronization Mode 1
When the time TSI GAP in the start sequence of the transmitted telegram has elapsed,
the receiver needs a certain time (GAPSync = 5...6 chips) to readjust the PLL settings.
Behavior of the system at the starting position of the TSI B:
The starting position (TSI B start) for the TSI B comparison is independent from the
RUNIN settings (CDR2 register) and the Re-synchronization mode (TSIMODE register):
The incoming chips at TSI B start and the following incoming chips are compared with
the contents of the register TSI B. Please notice that the receiver’s PLL runs at the data
rate determined before the gap. Therefore, the receiver calculates the gap based on this
data rate.
Behavior of the system at the ending position of TSI B:
The system checks for the TSI B to match within a limited time. If there is no match within
this time, then the receiver starts again to search for the TSI A pattern at the following
incoming chips:
For a successful TSI B pattern match, the defined TSI B pattern must be between “Start
of TSIB” and “Stop of TSI B”. In the example below, the earliest possible start position
would be the 18th chip and the latest possible start position would be the 22nd chip.
Please note that after a gap the internal TSI comparison register is cleared (all chips set
to ’0’). In this case, a TSI B criteria of “0000” would always match at the beginning. To
avoid such an unwanted matching, set the highest TSI B match chip to ’1’.
TSI A
TSI GAP
TSI B
valid data
all space or all mark
clock recovery reset
start point
PLL sync
internal PLL sync
RUNIN
GAPSync
< 1bit
TSIBstart chips
[]
TSIGAP chips
[] 6…8
+
=
TSIBstop chips
[]
TSIGAP chips
[] TSILENB chips
[] 11
++
=
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