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參數(shù)資料
| 型號： | TC59SM808BFTL-70 |
| 元件分類： | DRAM |
| 英文描述： | 32M X 8 SYNCHRONOUS DRAM, 5.4 ns, PDSO54 |
| 封裝： | 0.400 INCH, 0.80 MM PITCH, PLASTIC, TSOP2-54 |
| 文件頁數(shù)： | 41/49頁 |
| 文件大小： | 2437K |
| 代理商： | TC59SM808BFTL-70 |
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TC59SM816/08/04BFT/BFTL-70,-75,-80
2001-06-11
46/49
Figure 20. Timing chart for Burst Stop cycle (Precharge command)
DQ
PRCG
Q0
0
1
2
3
4
5
6
7
8
9
10
11
12
Q1
Q2
Q3
(1) Read Cycle
(a) CAS Latency
= 2
Command
Read
DQ
PRCG
(b) CAS Latency
= 3
Command
PRCG
Write
Command
Read
Q4
Q0
Q1
Q2
Q3
Q4
(2) Write Cycle
(a) CAS Latency
= 2
PRCG
DQM
Write
Command
D1
D2
D3
D4
(b) CAS Latency
= 3
DQ
D0
tWR
Note)
represents the Precharge command.
PRCG
DQ
D0
D1
D2
D3
D4
DQM
tWR
In the case of Burst Length
= 8
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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