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參數(shù)資料
| 型號(hào)： | TC59SM808BFTL-70 |
| 元件分類(lèi)： | DRAM |
| 英文描述： | 32M X 8 SYNCHRONOUS DRAM, 5.4 ns, PDSO54 |
| 封裝： | 0.400 INCH, 0.80 MM PITCH, PLASTIC, TSOP2-54 |
| 文件頁(yè)數(shù)： | 20/49頁(yè) |
| 文件大?。?/td> | 2437K |
| 代理商： | TC59SM808BFTL-70 |
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TC59SM816/08/04BFT/BFTL-70,-75,-80
2001-06-11
27/49
Figure 13. Power Down Mode
A0~A9,
A11, A12
CLK
0
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
CS
CKE
DQM
RAS
CAS
BS
A10
RAa
DQ
Active
WE
RAa
CAa
Note): The Power Down mode is invoked by asserting CKE “l(fā)ow”.
All Input/Output buffers (except the CKE buffer) are turned off in Power Down mode.
When CKE goes high, the No-operation command input must be at next CLK rising edge and CKE should be set high at least
1CLK
+ tCKS at Power Down Mode Exit.
Active
ax0
ax2
ax1
ax3
CAx
RAa
NOP
Precharge
&
Power Down Mode
Entry
NOP
tCKS
tSB
tCKS
Power Down Mode Exit
tCKS
tSB
tCKS
Power Down Mode Entry
Power Down Mode Exit
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