參數(shù)資料
型號(hào)： ST90R158T1
廠商： 意法半導(dǎo)體
英文描述： 8/16-BIT MCU FAMILY WITH UP TO 64K ROM/OTP/EPROM AND UP TO 2K RAM
中文描述： 微控制器16位產(chǎn)品的家庭多達(dá)64K的ROM /檢察官/ EPROM和2K的內(nèi)存
文件頁(yè)數(shù)： 61/190頁(yè)
文件大?。?/td> 1152K
代理商： ST90R158T1
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ST90158 - INTERRUPTS
INTERRUPT REGISTERS
(Cont’d)
EXTERNAL INTERRUPT VECTOR REGISTER
(EIVR
)
R246 - Read/Write
Register Page: 0
Reset value: xxxx 0110b (x6h)
Bit 7:4 =
V[7:4]
: Most significant nibble of External
Interrupt Vector
These bits are not initialized by reset. For a repre-
sentation of how the full vector is generated from
V[7:4] and the selected external interrupt channel,
refer to Figure 26.
Bit 3 =
TLTEV
: Top Level Trigger Event bit.
This bit is set and cleared by software.
0: Select falling edge as NMI trigger event
1: Select rising edge as NMItrigger event
Bit 2 =
TLIS
: Top Level Input Selection
This bit is set and cleared by software.
0: Watchdog End of Count is TL interrupt source
1: NMI is TL interrupt source
Bit 1 =
IA0S
: Interrupt Channel A0 Selection.
This bit is set and cleared by software.
0: Watchdog End of Count is INTA0 source
1: External Interrupt pin is INTA0 source
Bit 0 =
EWEN
: External Wait Enable.
This bit is set and cleared by software.
0: WAITN pin disabled
1: WAITN pin enabled (to stretch the external
memory access cycle).
Note:
For more details on Wait mode refer to the
section describing the WAITN pin in the External
Memory Chapter.
NESTED INTERRUPT CONTROL (NICR)
R247 - Read/Write
Register Page: 0
Reset value: 0000 0000 (00h)
Bit 7 =
TLNM
: Top Level Not Maskable
This bit is set by software and cleared only by a
hardware reset.
0: Top Level Interrupt Maskable. A top level re-
quest is generated if the IEN, TLI and TLIP bits
=1
1: Top Level Interrupt Not Maskable. A top level
request is generated if the TLIP bit =1
Bit 6:0 =
HL[6:0]
: Hold Levelx
These bits are set by hardware when, in Nested
Mode, an interrupt service routine at level x is in-
terrupted from a request with higher priority (other
than the Top Level interrupt request). They are
cleared by hardware at the
iret
execution when
the routine at level x is recovered.
7
0
V7
V6
V5
V4
TLTEV TLIS IAOS EWEN
7
0
TLNM
HL6
HL5
HL4
HL3
HL2
HL1
HL0
9
相關(guān)PDF資料
PDF描述
ST90R28 ROMLESS HCMOS MCU WITH RAM
ST90T30 128 x 128 pixel format, LED or EL Backlight available
ST90T30C1 9K EPROM HCMOS MCUs WOTH A/D COMVERTER
ST90T30C6 9K EPROM HCMOS MCUs WOTH A/D COMVERTER
ST90T31 9K EPROM HCMOS MCUs WOTH A/D COMVERTER
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參數(shù)描述
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ST90R26B6 制造商:未知廠家 制造商全稱:未知廠家 功能描述:8-Bit Microcontroller
ST90R28 制造商:STMICROELECTRONICS 制造商全稱:STMicroelectronics 功能描述:ROMLESS HCMOS MCU WITH RAM
ST90R28B1 制造商:STMICROELECTRONICS 制造商全稱:STMicroelectronics 功能描述:ROMLESS HCMOS MCU WITH RAM
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