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參數(shù)資料
| 型號： | ST7263BK1B/XXX |
| 廠商： | STMICROELECTRONICS |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 8-BIT, MROM, 8 MHz, MICROCONTROLLER, PDIP32 |
| 封裝： | 0.400 INCH, LEAD FREE, SHRINK, PLASTIC, DIP-32 |
| 文件頁數(shù)： | 11/140頁 |
| 文件大?。?/td> | 1423K |
| 代理商： | ST7263BK1B/XXX |
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ST7263B
108/140
13.5 CLOCK AND TIMING CHARACTERISTICS
Subject to general operating conditions for VDD, fCPU, and TA.
13.5.1 General Timings
Notes:
1. Data based on typical application software.
2. Time measured between interrupt event and interrupt vector fetch.
t
c(INST) is the number of tCPU cycles needed to finish
the current instruction execution.
13.5.2 CONTROL TIMING CHARACTERISTICS
Note:
1. Not tested in production, guaranteed by characterization.
Symbol
Parameter
Conditions
Min
Typ 1)
Max
Unit
tc(INST)
Instruction cycle time
fCPU=8MHz
23
12
tCPU
250
375
1500
ns
tv(IT)
Interrupt reaction time 2)
tv(IT) = tc(INST) + 10 tCPU
fCPU=8MHz
10
22
tCPU
1.25
2.75
s
CONTROL TIMINGS
Symbol
Parameter
Conditions
Value
Unit
Min
Typ.
Max
fOSC
Oscillator Frequency
24
MHz
fCPU
Operating Frequency
8
MHz
tRL
External RESET
Input pulse Width
2520
ns
tPORL
Internal Power Reset Duration
4096
tCPU
TDOGL
Watchdog or Low Voltage Reset
Output Pulse Width
200
300
ns
tDOG
Watchdog Time-out
fcpu = 8MHz
49152
6.144
3145728
393.216
tCPU
ms
tOXOV
Crystal Oscillator
Start-up Time
201)
30
401)
ms
tDDR
Power up rise time
from VDD = 0 to 4V
1001)
ms
相關(guān)PDF資料 |
PDF描述 |
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
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