參數(shù)資料
型號(hào)： ST10F276Z5Q3
廠商： STMICROELECTRONICS
元件分類： 微控制器/微處理器
英文描述： 16-BIT, MROM, 64 MHz, RISC MICROCONTROLLER, PQFP144
封裝： 28 X 28 MM, 3.40 MM HEIGHT, PLASTIC, QFP-144
文件頁數(shù)： 117/239頁
文件大?。?/td> 2271K
代理商： ST10F276Z5Q3
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ST10F276Z5
Electrical characteristics
23.8.12
PLL lock/unlock
During normal operation, if the PLL is unlocked for any reason, an interrupt request to the
CPU is generated and the reference clock (oscillator) is automatically disconnected from the
PLL input: In this way, the PLL goes into free-running mode, providing the system with a
backup clock signal (free running frequency Ffree). This feature allows to recover from a
crystal failure occurrence without risking to go into an undefined configuration: The system
is provided with a clock allowing the execution of the PLL unlock interrupt routine in a safe
mode.
The path between the reference clock and PLL input can be restored only by a hardware
reset, or by a bidirectional software or watchdog reset event that forces the RSTIN pin low.
Note:
The external RC circuit on RSTIN pin must be the right size in order to extend the duration of
the low pulse to grant the PLL to be locked before the level at RSTIN pin is recognized high:
Bidirectional reset internally drives RSTIN pin low for just 1024 TCL (definitely not sufficient
to get the PLL locked starting from free-running mode).
Conditions: VDD = 5 V ±10%, TA = –40 / +125
oC
23.8.13
Main oscillator specifications
Conditions: VDD = 5 V ±10%, TA = –40 / +125 °C
Table 99.
PLL lock/unlock timing
Symbol
Parameter
Conditions
Value
Unit
Min.
Max.
TPSUP
PLL Start-up time (1)
1.
Not 100% tested, guaranteed by design characterization.
Stable VDD and reference clock
–
300
s
TLOCK
PLL Lock-in time
Stable VDD and reference clock,
starting from free-running mode
–
250
TJIT
Single Period Jitter (1)
(cycle to cycle = 2 TCL)
6 sigma time period variation
(peak to peak)
–500
+500
ps
Ffree
PLL free running
frequency
Multiplication factors: 3, 4
Multiplication factors: 5, 8, 10, 16
250
500
2000
4000
kHz
Table 100.
Main oscillator specifications
Symbol
Parameter
Conditions
Value
Unit
Min.
Typ.
Max.
gm
Oscillator transconductance
8
17
35
mA/V
VOSC
Oscillation amplitude (1)
1.
Not 100% tested, guaranteed by design characterization
Peak to peak
–
VDD – 0.4
–
V
VAV
Oscillation voltage level (1)
Sine wave middle
–
VDD / 2 –0.25
–
tSTUP
Oscillator start-up time (1)
Stable VDD - crystal
–
3
4
ms
Stable VDD, resonator
–
2
3
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