參數(shù)資料
型號： SI5321-G-BC
廠商： Silicon Laboratories Inc
文件頁數(shù)： 19/34頁
文件大?。?/td> 0K
描述： IC PREC CLOCK MULTIPLIER 63CBGA
標(biāo)準(zhǔn)包裝： 260
系列： DSPLL®
類型： 時鐘乘法器
PLL： 是
輸入： LVTTL
輸出： CML
電路數(shù)： 1
比率 - 輸入:輸出： 1:1
差分 - 輸入:輸出： 是/是
頻率 - 最大： 2.8GHz
除法器/乘法器： 是/是
電源電壓： 3.135 V ~ 3.465 V
工作溫度： -20°C ~ 85°C
安裝類型： 表面貼裝
封裝/外殼： 63-CBGA
供應(yīng)商設(shè)備封裝： 63-CBGA（9x9）
包裝： 托盤
其它名稱： 336-1274
Si5321
26
Rev. 2.5
H5
H8
B3
FRQSEL[0]
FRQSEL[1]
FRQSEL[2]
I*
LVTTL*
Clock Output Frequency Range Select.
Select the frequency range of the clock output, CLK-
001 = 19 MHz Frequency Range.
000 = 39 MHz Frequency Range.
100 = 78 MHz Frequency Range.
010 = 155 MHz Frequency Range.
101 = 311 MHz Frequency Range.
011 = 622 MHz Frequency Range.
110 = 1.25 GHz Frequency Range.
111 = 2.5 GHz Frequency Range.
A3
A2
B2
FEC[0]
FEC[1]
FEC[2]
I*
LVTTL*
FEC Selection.
Enables or disables scaling of the input-to-output
frequency multiplication factor for FEC clock rate
compatibility.
The frequency of the CLKOUT output is a multiple of
the frequency of the CLKIN input. Selecting the
clock input range, the clock output range, and the
FEC scaling factor sets the input-to-output fre-
quency multiplication factor. The clock output fre-
quency is selected using the FRQSEL[2:0] pins. The
clock input frequency is selected using the INFRQ-
SEL[2:0] pins. Scaling factors of 255/238, 238/255,
255/237, 237/255, 66/64, or 64/66 may be selected
for FEC operation using the FEC[2:0] control pins as
indicated below. Scaling factors of 255/237, 237/
255, 66/64, or 64/66 require that the input clock rate
be in the 155 MHz or higher range.
000 = No FEC scaling.
001 = 255/238 FEC scaling.
010 = 238/255 FEC scaling.
011 = Reserved.
100 = 255/237 FEC scaling (155 MHz or higher
input clock range required).
101 = 237/255 FEC scaling (155 MHz or higher
input clock range required).
110 = 66/64 FEC scaling (155 MHz or higher input
clock range required).
111 = 64/66 FEC scaling (155 MHz or higher input
clock range required).
Table 10. Si5321 Pin Descriptions (Continued)
Pin #
Pin Name
I/O
Signal Level
Description
*Note:
The LVTTL inputs on the Si5321 device have an internal pulldown mechanism that causes the input to default to a
logic low state if the input is not driven from an external source.
相關(guān)PDF資料
PDF描述
SI5321-H-BL IC CLOCK MULT SONET/SDH 63-PBGA
SI5322-B-GM IC PREC CLOCK MULTIPLIER 36QFN
SI5323-B-GM IC MULTIPLIER/ATTENUATOR 36QFN
SI5325A-C-GM IC UP-PROG CLK MULTIPLIER 36-QFN
SI5326A-C-GM IC ANY-RATE MULTI/ATTEN 36-QFN
相關(guān)代理商/技術(shù)參數(shù)
參數(shù)描述
SI5321-G-XC2 制造商:Silicon Laboratories Inc 功能描述:
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Si5321-H-GL 功能描述:時鐘發(fā)生器及支持產(chǎn)品 SONET/SDH Precisn Clock Multiplr RoHS:否 制造商:Silicon Labs 類型:Clock Generators 最大輸入頻率:14.318 MHz 最大輸出頻率:166 MHz 輸出端數(shù)量:16 占空比 - 最大:55 % 工作電源電壓:3.3 V 工作電源電流:1 mA 最大工作溫度:+ 85 C 安裝風(fēng)格:SMD/SMT 封裝 / 箱體:QFN-56
SI5321-H-ZL2 制造商:Silicon Laboratories Inc 功能描述:
Si5321-XLNX-DC 功能描述:子卡和OEM板 Silabs/Xilinx Ref Design RoHS:否 制造商:BeagleBoard by CircuitCo 產(chǎn)品:BeagleBone LCD4 Boards 用于:BeagleBone - BB-Bone - Open Source Development Kit
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