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參數資料
| 型號： | SC418ULTRT |
| 廠商： | Semtech |
| 文件頁數： | 6/30頁 |
| 文件大?。?/td> | 691K |
| 描述： | IC REG DL BUCK/LINEAR 20MLPQ |
| 產品培訓模塊： | Power Supplies 101 |
| 標準包裝： | 1 |
| 系列： | EcoSpeed® |
| 拓撲： | 降壓（降壓）（1），線性（LDO）（1） |
| 功能： | 任何功能 |
| 輸出數： | 2 |
| 頻率 - 開關： | 1MHz |
| 電壓/電流 - 輸出 1： | 控制器 |
| 電壓/電流 - 輸出 2： | 0.75 V ~ 5.25 V，200mA |
| 帶 LED 驅動器： | 無 |
| 帶監(jiān)控器： | 無 |
| 帶序列發(fā)生器： | 無 |
| 電源電壓： | 3 V ~ 28 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 20-MLPQ |
| 供應商設備封裝： | 20-MLPQ（3x3） |
| 包裝： | 標準包裝 |
| 其它名稱： | SC418ULTRTDKR |
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SC418
6
Electrical Characteristics (continued)
Parameter
Conditions
Min Typ Max Units
High-Side Driver (DH, BST, LX)
Peak Current
(2)
VDDP = 5V
2.0
A
On Resistance
R
DH_PULL-UP,
LX < 0.5V, VDDP = 5V
3.0 6.0 &
R
DH_PULL-UP,
LX > 0.5V, VDDP = 5V
.0 2.0 &
R
DH_PULL-DOWN,
VDDP = 5V
0.6 .2 &
Rise Time
(2)
C
DH-LX
= 3nF, VDDP = 5V
22
ns
Fall Time
(2)
C
DH-LX
= 3nF, VDDP = 5V
2
ns
Propagation Delay
(2)
From FB Comparator Input to DH
30 45 60 ns
Shoot-thru Protection Delay
(2)
0 20 30 ns
Bootstrap Switch Resistance
0
&
Low-Side Driver (DL, VDDP, PGND)
Peak Current
(2)
VDDP = 5V
4.0
A
On Resistance
R
DL_PULL-UP,
VDDP = 5V
.3 2. &
R
DL_PULL-DOWN,
VDDP = 5V
0.50 0.86 &
Rise Time
(2)
C
DL
= 3nF, VDDP = 5V
7
ns
Fall Time
(2)
C
DL
= 3nF, VDDP = 5V
3.5
ns
Notes:
() VIN UVLO is programmable using a resistor divider from VIN to ENL to AGND. The ENL voltage is compared to an internal reference.
(2) Guaranteed by design.
(3) For VDDA less than 4.5V, the On-Time may be limited by the VDDA supply voltage and by V
IN
. See the TON Limitations and VDDA Supply
Voltage section in the Applications Information.
(4) The ENL pin will enable the LDO with .0V typical. The ENL pins VIN ULVO function will disable the switcher unless the ENL pin exceeds the
V
IN
UVLO Threshold (typical 2.5V).
(5) The switch-over threshold is the maximum voltage differential between the VLDO and VOUT pins which ensures that VLDO will internally
switch-over to VOUT. The non-switch-over threshold is the minimum voltage differential between the VLDO and VOUT pins which ensures
that VLDO will not switch-over to VOUT.
(6) The LDO drop out voltage is the voltage at which the LDO output drops 2% below the nominal regulation point.
相關PDF資料 |
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